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  1. modifiedjakesmodel

    171/0人气/下载:
  2. modified jakes model. matlab code.working fine
  3. 所属分类:matlab

    • 发布日期:2017-06-24
    • 文件大小:1024
    • 提供者:debasish ghose
  1. MSP430_LCD(TG1501A)

    169/0人气/下载:
  2. MSP430 LCD(TG1501A)通过spi通信显示-MSP430 LCD(TG1501A) Display by spi communication
  3. 所属分类:SCM

    • 发布日期:2017-06-24
    • 文件大小:46080
    • 提供者:regan
  1. watch

    136/0人气/下载:
  2. 使用vhdl设计数码管显示的秒表; 能够准确的计时并显示; 开机显示00.00.00; 用户可以随时清零、暂停、计时;最大记时59分钟,最小精确到0.01秒。-Vhdl design digital display stopwatch accurate timing and display boot display 00.00.00 Users can be cleared at any time, suspend, timing 59 minutes maximum chronogra
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:346112
    • 提供者:陈小龙
  1. jiaotongdeng

    116/0人气/下载:
  2. 使用vhdl语言设计交通信号灯。由一条主干道和一条支干道汇合成十字路口,在每个入口处设置红、绿、黄三色信号灯,红灯亮禁止通行,绿灯亮允许通行,黄灯亮则给行驶中的车辆有时间停在禁行线外。主干道处于常允许通行的状态,支干道有车来时才允许通行,主、支干道均有车时,两者交替允许通行,主、支干道每次放行时间不得短于30S,在每次由绿灯亮到红灯亮的转换过程中,要亮4S黄灯作为过渡。 -Using vhdl language design traffic lights. By a main road a
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:57344
    • 提供者:陈小龙
  1. shuzizhong

    119/0人气/下载:
  2. 使用vhdl语言设计电子钟。具有时、分、秒计数功能,且以24小时循环计时。计时结果要用6个数码管分别显示时、分、秒的十位和个位。具有清零功能。 -Use vhdl languages ​ ​ designed electronic clock. Has hours, minutes, seconds count and a 24-hour cycle timing. The timing results use six digital tube display hours
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:322560
    • 提供者:陈小龙
  1. qicheweideng

    223/0人气/下载:
  2. 使用vhdl语言设计的汽车尾灯控制电路。用六个发光二极管模拟6个汽车尾灯(汽车尾部左,右各3个),用两个开关作为转弯控制信号(一个开关控制右转弯,另一个开关控制左转弯)。当汽车往前行驶时(此时两个开关的都未接通),6个灯全灭。当汽车转弯时,若右转弯(即右转开关接通),右边3个尾灯从左至右顺序亮灭,左边3个灯全灭;若左转弯(即左转开关接通),左边3个尾灯从右至左顺序亮灭,右边3个灯全灭。当左、右两个开关同时接通时,6个尾灯同时明、暗闪烁。 -The taillights control cir
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:137216
    • 提供者:陈小龙
  1. pingpangqiu

    222/0人气/下载:
  2. 使用vhdl语言设计的乒乓球比赛游戏机,一个由甲乙双方参赛,有裁判的三人乒乓球游戏机。用8个发光二极管代表乒乓球台,中间两个发光二极管兼做乒乓球网,两边各代表参赛双方的位置,用点亮二极管按照一定方向移动来表示球的运动。在游戏机的两侧各设置两个开关,一个是发球开关(af,bf),另一个是击球开关(aj,bj)。甲乙二人按乒乓球比赛的规则来操作开关。 点亮,代表乒乓球在移动。比赛一直进行到一方几分为11分,该局结束,记分牌清零,可以开始新的一局比赛。 -Using VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:492544
    • 提供者:陈小龙
  1. chuzuche

    152/0人气/下载:
  2. 使用vhdl语言设计的出租车计费器。实现计费功能,计费标准为:按行驶里程收费。起步价是8.00元,并在行驶3公里后,在按1.90元/公里计费。当计费器达到或超过20元时,每公里加收50 的车费,车停止是不计费。 显示功能:将车费及里程显示出来,车费和里程显示各使用4位数码管。 模拟功能:能模拟汽车启动,停止,暂停以及加速等状态。 -Using vhdl language design taxi meter. Billing functions, accounting standard
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:579584
    • 提供者:陈小龙
  1. caidengkongzhiqi

    132/0人气/下载:
  2. 一个使用vhdl语言设计的彩灯控制器,使彩灯(LED管)能连续发出四种以上不同的显示形式;多种花型可以自动变换,循环往复;彩灯变换的快慢节拍可以选择;具有清零开关。-A lantern controller design using vhdl language, lantern (LED tube) can continuously send more than four different display forms kinds of flowers can automatically tr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-24
    • 文件大小:353280
    • 提供者:陈小龙
  1. Electronic-clock

    145/0人气/下载:
  2. 多功能电子时钟,51,有FM收音机、温度、多闹钟设置、时间调整,农历,节日提醒-Multifunction Electronic clock, 51, FM radio, temperature, multiple alarm settings, time to adjust, Lunar New Year, holiday reminder
  3. 所属分类:SCM

    • 发布日期:2017-06-24
    • 文件大小:285696
    • 提供者:步弦
  1. DBIO_BIN_V1.00

    136/0人气/下载:
  2. DBIO is an testing software simulate OLTP I/O workload
  3. 所属分类:Java Develop

    • 发布日期:2017-06-24
    • 文件大小:447488
    • 提供者:Jarvis
  1. FFT2

    194/0人气/下载:
  2. of the apparent uplift field. Left: The deformation map draped over a shaded relief map of the VVZ. The blue ticked lines indicate the possible positions of normal faults, whilst the black lines indicate Bouguer anomaly gravity contours (contours are
  3. 所属分类:Other systems

    • 发布日期:2017-06-24
    • 文件大小:4412416
    • 提供者:yoshihiro
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