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文件名称:FPGA_Clk

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-10-21
  • 文件大小：
    1.4mb
  • 已下载：
    0次
  • 提 供 者：
    icemo******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于Cyclone EP1C6240C8 FPGA的时钟产生模块。主要用于为FPGA系统其他模块产生时钟信号。采用verilog编写。

使用计时器的方式产生时钟波形。

提供对于FPGA时钟的偶数分频、奇数分频、始终脉冲宽度等功能。-Based on Cyclone EP1C6240C8 FPGA' s clock generator module. Is mainly used for the FPGA system clock signal generated in other modules. The use of the timer-generated clock waveform. To provide for the FPGA clock even sub-frequency, odd-numbered sub-frequency, pulse width is always functions.
相关搜索： FPGA timer vhdl clock generator clock signal in fpga FPGA 时钟 clock generator vhdl cyclone FPGA 产生 脉冲 波形 VHDL Generator

(系统自动生成,下载前可以参看下载内容)

下载文件列表

FPGA_Clk/db/add_sub_8rh.tdf
FPGA_Clk/db/altsyncram_kso3.tdf
FPGA_Clk/db/altsyncram_qso3.tdf
FPGA_Clk/db/cmpr_j4c.tdf
FPGA_Clk/db/cmpr_l4c.tdf
FPGA_Clk/db/cmpr_n4c.tdf
FPGA_Clk/db/cntr_a4i.tdf
FPGA_Clk/db/cntr_c4i.tdf
FPGA_Clk/db/cntr_cti.tdf
FPGA_Clk/db/cntr_iti.tdf
FPGA_Clk/db/cntr_p2i.tdf
FPGA_Clk/db/cntr_umi.tdf
FPGA_Clk/db/decode_9jf.tdf
FPGA_Clk/db/FPGA_Clk.(0).cnf.cdb
FPGA_Clk/db/FPGA_Clk.(0).cnf.hdb
FPGA_Clk/db/FPGA_Clk.(1).cnf.cdb
FPGA_Clk/db/FPGA_Clk.(1).cnf.hdb
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FPGA_Clk/db/FPGA_Clk.(7).cnf.hdb
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FPGA_Clk/db/FPGA_Clk.(8).cnf.hdb
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FPGA_Clk/db/FPGA_Clk.(9).cnf.hdb
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FPGA_Clk/db/FPGA_Clk.cbx.xml
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FPGA_Clk/db/FPGA_Clk.cmp.cdb
FPGA_Clk/db/FPGA_Clk.cmp.ecobp
FPGA_Clk/db/FPGA_Clk.cmp.hdb
FPGA_Clk/db/FPGA_Clk.cmp.kpt
FPGA_Clk/db/FPGA_Clk.cmp.logdb
FPGA_Clk/db/FPGA_Clk.cmp.rdb
FPGA_Clk/db/FPGA_Clk.cmp.tdb
FPGA_Clk/db/F

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