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搜索资源列表

  1. test_cpu

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  2. 自己编的小型CPU,可执行简单的代码,作为对开发CPU的尝试。里面包含ROM和CPU。CPU通过状态机执行指令。在Modelsim中仿真通过。-Small VHDL CPU,as a example for developing CPU. It is simulated by Modelsim.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:249008
    • 提供者:123
  1. BlueToothC51

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  2. 本程序是一个用C51语言编写的,可以同时利用COM串口收发数据,并使用看门狗,也体现了状态机。-This is programmed by C51 language.Using the COM port,it can receive and send data simultaneously.Is also uses watch dog and status mechanism.
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2013-12-02
    • 文件大小:6779
    • 提供者:钱文良
  1. State-machine-

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  2. FPGA设计资料,新手入门资料,,状态机设计,-FPGA design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-23
    • 文件大小:115067
    • 提供者:liu
  1. jtd

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  2. 用VHDL编写的智能交通灯控制器,使用的是状态机机制实现状态的转换-Prepared using VHDL intelligent traffic lights controller, using a state machine mechanism to realize the conversion of the state
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1826816
    • 提供者:刘星
  1. Verilog-FSM

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  2. VERILOG HDL 学习有限状态机的重要PPT-VERILOG HDL FSM PPT
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3752235
    • 提供者:杨凯
  1. sequence-check

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  2. 设计一个有限状态机,用以检测输入序列“1110010”-sequence check
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:12407
    • 提供者:王雪茹
  1. STATE-CHECK

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  2. 设计一个有限状态机,用以检测输入序列“1110010”-state check
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:24784
    • 提供者:王雪茹
  1. 123

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  2. 在FPGA中用状态机实现对数码管的控制很好的了解一下状态机-State machine in the FPGA with the control of the digital control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:966423
    • 提供者:王得鑫
  1. src

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  2. 在spartan3e实验板上实现交通灯的功能,采用状态机描述。-traffic lights design on spartan3e board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:6811
    • 提供者:kuailishan
  1. tlc549adc

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  2. 利用状态机实现对TLC549的采样控制,改变ADC的模拟量输入值,数据采集读取后在数码管上显示。-State machine to achieve the TLC549 sampling control, to change the ADC analog input value, the data acquisition read on the digital tube display.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:121580
    • 提供者:黄远豪
  1. tlc5620dac

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  2. 利用状态机实现对tlc5620dac控制,实验时按key1,可选择DAC的通道,数码管1显示,按key2,key3可 输入8位数/模转换值,由数码管3,4显示,按key4,选择输出电压模式,由数码管8显示,0表示1倍,1表示2倍,按key5,将当前数据发送到DAC模块启动一次DA转换,-State machine implementation control on tlc5620dac, press key1 experiment, you can choose the DAC channe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:675475
    • 提供者:黄远豪
  1. selection-mechanism-driven

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  2. 多线程并发服务器设计 有限状态机与有状态通信 基于消息驱动的异步选择机制 -Multi-threaded concurrent server design Finite state machine and a state of communication Based on the news of the selection mechanism driven asynchronous
  3. 所属分类:CSharp

    • 发布日期:2017-05-02
    • 文件大小:890687
    • 提供者:梦竹
  1. Sequential-detection

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  2. 序列检测器的vhdl设计(用状态机实现序列检测器的设计,了解一般状态机的设计与应用。)-Sequential detection
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:798
    • 提供者:lmy
  1. FPGAled

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  2. 通过状态机对输出状态进行切换,产生不同的效果-Through the state machine to switch the output state, produce different effect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:402595
    • 提供者:
  1. 11111

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  2. 1、用FPGA/CPLD实现HS162字符液晶显示。 2、分析相应的功能要求,分析CPLD与字符液晶HS162的接口典型电路。 3、利用状态机的设计方法,通过指令编程实现对HS162-4液晶模块的读/写操作,以及屏幕和光标的操作。 4、编写模块的Verilog HDL语言的设计程序。 5、在Quartus II软件或其他EDA软件上完成设计和仿真。 -This design of a CPLD-based controls HS162 to achieve character
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-06
    • 文件大小:1046396
    • 提供者:kevin mk li
  1. single_long_double_button

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  2. 采用ATMEGA48单片机,采用状态机实现按键的单击、双击、长按的按键功能-The ATMEGA48 microcontroller, using the state machine to implement the double click click button long press keys function
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:105018
    • 提供者:林煌
  1. 2

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  2. 该程序基于labview的基础上编写而成,利用状态机实现的温度采集-The program is based on LabVIEW on the basis of written using the state machine to achieve the temperature acquisition
  3. 所属分类:Other systems

    • 发布日期:2017-04-07
    • 文件大小:59519
    • 提供者:liuhuijin
  1. C-programme-for-fsm

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  2. 介绍了4种C的有限状态机写法,但愿能帮到你-introduce 4 kinds of fsm style in C language
  3. 所属分类:source in ebook

    • 发布日期:2017-04-02
    • 文件大小:58851
    • 提供者:wang
  1. one_hot

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  2. 用Veriloghdl编写的one_hot独热码状态机程序和测试程序。-The one_hot code state machine program and test programs written with VerilogHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:19917
    • 提供者:juzi
  1. verilog-state-machine

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  2. 使用VerilogHDL语言的小教程。 用三段式方法编写状态机。 有清晰详细的注释。-A small tutorial teaching how to write the state machine using three-step method in VerilogHDL language. There are clear and detailed notes in the tutorial.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2015-07-28
    • 文件大小:335872
    • 提供者:juzi
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