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搜索资源列表

  1. chuzuche

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  2. Verilog编写的出租车计价程序,Altera公司的DE2开发板环境中。-Taximeter program written by Verilog, Altera' s DE2 development board environment.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-08
    • 文件大小:1490633
    • 提供者:ganding
  1. SEG

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  2. 采用DE2 实现数码管递增 VERILOG-Using DE2 achieve the digital pipe incremental VERILOG
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:981
    • 提供者:金纯
  1. DE2_70_TV

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  2. de2 70 开发板的演示程序,verilog语言编写,视频输入输出-de2 70 development board demo program, verilog language written, video input and output
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-10-31
    • 文件大小:181036
    • 提供者:chris
  1. PWM

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  2. 用Verilog编写的PWM产生器,已经在cyclon DE2板子上测试通过,建议用Quartus 10.1综合。-PWM generator using Verilog.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-01
    • 文件大小:4524853
    • 提供者:Cristie
  1. SoftDrink

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  2. 用Verilog编写的自动售货机控制程序,在cyclon DE2开发板上测试通过,建议用Quartus 10.1编译。-Vending machine control program written using Verilog test by in cyclon DE2 development board, we recommend using Quartus 10.1 compiler.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-30
    • 文件大小:2067866
    • 提供者:Cristie
  1. DE2_115_Audio

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  2. DE2-115开发板音频录放verilog HDL代码-DE2-115 development board audio recorders verilog HDL code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:1906350
    • 提供者:张海军
  1. DE2_115_NIOS_DEVICE_LED

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  2. DE2-115开发板的LED灯设计 Verilog HDL语言编写-DE2-115 development board LED lamp design Verilog HDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:4140081
    • 提供者:张海军
  1. DE2_115_NIOS_HOST_MOUSE_VGA

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  2. DE2-115开发板的verilog HDL的VGA设计-DE2-115 development board VGA verilog HDL design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-20
    • 文件大小:4288087
    • 提供者:张海军
  1. DE2_115_PS2_DEMO

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  2. DE2-115开发板的PS2的Verilog HDL语言设计-The DE2-115 development board of the PS2 Verilog HDL language design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:90964
    • 提供者:张海军
  1. SDRAM

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  2. 用Verilog HDL语言编写的SDRAM控制器,在DE2-70的开发板上实现。-SDRAM Controller with Verilog HDL language, DE2-70 development board.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-12
    • 文件大小:154454
    • 提供者:李桐
  1. Counter_10

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  2. verilog 计数器,每计数到十清零,可以直接下载到DE2-70开发板-verilog counter
  3. 所属分类:Other systems

    • 发布日期:2017-11-25
    • 文件大小:275305
    • 提供者:刘勇
  1. project1

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  2. 4比1多路选择器,HDl verilog语言编写,能在DE2上运行-4 to 1 multiplexer, HDl verilog language, able to run on the DE2
  3. 所属分类:Other systems

    • 发布日期:2017-12-09
    • 文件大小:259288
    • 提供者:董凯明
  1. project2_1

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  2. 3:8译码器,HDl verilog语言编写,能在DE2上运行-3:8 decoder, HDl verilog language, able to run on the DE2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:244719
    • 提供者:董凯明
  1. project2_2

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  2. 7段译码管,用于显示数字,HDl verilog语言编写,能在DE2上运行-7 segment decoder tube used to display numbers, HDl verilog language, can be run on the DE2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-26
    • 文件大小:267130
    • 提供者:董凯明
  1. project3_1

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  2. 逐次进位加法器,HDl verilog语言编写,能在DE2上运行-Successive carry adder, HDl verilog language, able to run on the DE2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-09
    • 文件大小:269363
    • 提供者:董凯明
  1. project4_1

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  2. D触发器门级实现,有异步复位置位,HDl verilog语言编写,能在DE2上运行-D flip-flop gate-level implementation, there are asynchronous Reset_Set, HDl verilog language, able to run on the DE2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-05
    • 文件大小:243256
    • 提供者:董凯明
  1. pinpongf16

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  2. FPGA Verilog程序 采用DE2-70 Altrer 实验班实现小球跳动-FPGA Verilog program using DE2-70 Altrer experimental class of small ball beating
  3. 所属分类:Other systems

    • 发布日期:2017-11-27
    • 文件大小:11762
    • 提供者:wang
  1. VGA1

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  2. 基于ALTERA DE2 开发板开发的VGA外接屏Verilog显示程序。-ALTERA DE2 development board based on the development of Verilog VGA external screen display program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:2233590
    • 提供者:善解人衣
  1. DE2_70_VGA_only

    0下载:
  2. de2-70 开发板上的bga驱动,用VERILOG写得,希望对大家有用,这个随意显示几个彩条。-de2-70 development board bga driven, with VERILOG written, we want to be useful, this random display several color bars.
  3. 所属分类:MiddleWare

    • 发布日期:2017-04-08
    • 文件大小:641606
    • 提供者:zhangqiying
  1. jiaozhi

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  2. 完成通信系统中数据交织器的设计的设计,要求用Verilog HDL编程,在DE2平台上实现,在示波器上显示观察。-Complete data communication system Interleaver Design for the design, requirements using Verilog HDL programming, implemented on the DE2 platform, observed on the oscilloscope display.
  3. 所属分类:Other systems

    • 发布日期:2017-04-09
    • 文件大小:1369646
    • 提供者:林健
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