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搜索资源 - parallel to serial
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AT89S51的并行口P1接4×4矩阵键盘，以P1.0－P1.3作输入线，以P1.4－P1.7作输出线；在数码管上显示每个按键的“0－F”序号。-AT89S51 the parallel port P1 then 4 × 4 matrix keyboard to P1.0-P1.3 as input lines to P1.4-P1.7 for output line in the digital control button displayed on each of the " 0-
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this program based on MCS51 and converts a serial data to parallel on its port
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a simple serial to parallel converter using XILLINX and VHDL (the number of the project represents the binary code used by the converter e.g 23- 10111)
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本文着重探讨用多线程并行的方式通过多个串口进行并行通信。使用多线程进行串行
通信的文献已有一些，但都没涉及到多个串口并行的情况。本文介绍的多串口多线程通信方
法，使多个串口并行通信，从而实现大规模的数据采集与高速数据传输操作。
关键词：多线程；串行通信；同步
-This article focused on the use of multi-threaded parallel manner parallel through multiple serial communic
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Xilinx USB JTAG 下載端程式
-The jtag_logic.vhd in this directory describes the logic for a parallel-serial converter
to be connected to a FT245BM USB chip from FTDI Inc
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功能描述：将并行的48个位，转换成串行输出的数据
实现原理：输出数据要在输出时钟的上升沿锁存-Functional Descr iption: The 48-bit parallel, serial output into the realization of the principle of data: output data to output clock rising edge latches
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SSI对从外设器件接收到的数据执行串行到并行转换。CPU可以访问SSI数据寄存器来发送和获得数据。发送和接收路径利用内部FIFO存储单元进行缓冲，以允许最多8个16位的值在发送和接收模式中独立地存储。
使用 ssi 控制1位数码管的显示-SSI received from peripheral devices to the implementation of the serial to parallel data conversion. CPU can access data regi
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Supplemental information for a high-speed serial bus that integrates well with most IEEE standard
32-bit and 64-bit parallel buses is specified. It is intended to extend the usefulness of a low-cost interconnect
between external peripherals, IEEE
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这是串转并的程序，能够张串行的数据，变成并行的数据-This is the string and the procedure to be able to Zhang serial data into parallel data
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This code contain the Serial to Parallel based state machine.
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serial to parallel vhdl code
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使用M F C的C F i l e类通过指定COM1: 或者L P T 2 :来实现与这些设备的通信，将读写操作转换为与串行或者将并行设备的实际转换过程由硬件驱动程序完成-CF ile of the use of MFC category by specifying COM1: or LPT 2: to achieve the communication with these devices will be converted to read and write operations with
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串并FIR滤波器设计:并行FIR滤波器具有速度快、容易设计的特点，但是要占用大量的资源。在多阶数的亚高频系统设计中，使用并行结构并不合算，但亚高频系统需要较高的处理速度，而串行架构往往达不到要求，因此，结合串并这两种设计方法的长处，在使用较少的硬件资源的同时实现了较高的处理速度，这里说明一种65阶八路并行、支路串行FIR滤波器的设计（实际使用了1个乘法器，8个乘累加器，一个累加器）。-String and FIR filter design: parallel FIR filter with a
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并行接口数模转换器的引脚多，体积大，占用单片机的口线多；而串行数模转换器的体积小，占用单片机的口线少，为减少线路板的面积和占用单片机的口线，可采用TCL5615串行数模转换器产生可变基准电压。 -Pin parallel interface DACs and more bulky, taking up the mouth of single-chip multi-line and serial DACs small size, occupied by small SCM I lines, in
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开发工具： MedWin v2.39单片机集成开发环境，AT89C51单片机，Insight ME-52H仿真机，RP-3000通用型编程器。
项目描述：
这是一个通用中间件，在模拟量输入前可接各种物理量的传感器，完成物理信号的测量与显示；在模数变换后将数字量通过并行总线引入单片机系统，可生成标准的EIA协议，再经由RS232串口引入通用机系统,完成进一步的处理或界面表征。-Tools: MedWin v2.39 single-chip integrated development
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并行数据转换串行数据发生VHDL程序，需要的同志可以看看是否可以用 自己写的-Serial data in parallel data conversion process occurred in VHDL, the comrades need to see if it can be written in their own
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串行数据转换并行数据接收，同志们看看 我觉得不错 自己写的 都用上了-Serial data receiving parallel data conversion and comrades feel good to see I wrote it myself have used
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74HCT164 是 8 位边沿触发式移位寄存器，串行输入数据，然后并行输出。数据通过两个输入端（DSA 或 DSB）之一串行输入；任一输入端可以用作高电平使能端，控制另一输入端的数据输入。两个输入端或者连接在一起，或者把不用的输入端接高电平，一定不要悬空。-74HCT164 is an 8-bit edge triggered shift register, serial input data, and then output in parallel. Data input through t
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CH341是一个USB总线的转接芯片，通过USB总线提供串口、打印口或者并口。
在串口方式下，CH341提供串口发送使能、串口接收就绪等交互式的速率控制信号以
及常用的MODEM联络信号，用于将普通的串口设备直接升级到USB总线。 -CH341 is a USB bus adapter chips, provided through the USB serial bus, printer port or parallel port. In serial mode, CH341 Send
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FYD12864-0402B是一种具有4位/8位并行、2线或3线串行多种接口方式，内部含有国标一级、二级简体中文字库的点阵图形液晶显示模块；其显示分辨率为128×64, 内置8192个16*16点汉字，和128个16*8点ASCII字符集.利用该模块灵活的接口方式和简单、方便的操作指令，可构成全中文人机交互图形界面-FYD12864-0402B is a 4/8 bit parallel, 2 line or 3-wire serial interface a variety of ways,
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