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搜索资源列表

  1. ep1c12_29_dds

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  2. 基于周立功SOPC实验开发平台,利用VHDL语言,实现DDS调频-Zhou, who based SOPC experimental development platform, using VHDL language, to achieve DDS FM
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:110825
    • 提供者:Vincent Zhao
  1. vhdl2

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  2. vhdl语言正弦信号发生器设计,传统的用分立元件或通用数字电路元件设计电子线路的方法设计周期长,花费大, 可移植性差。本文以正弦波发生器为例,利用EDA 技术设计电路,侧重叙述了用VHDL 来完 成直接数字合成器(DDS) 的设计,DDS 由相位累加器和正弦ROM 查找表两个功能块组成,其 中ROM查找表由兆功能模块LPM-ROM来实现。-The traditional use of discrete components or general purpose digital cir
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:94354
    • 提供者:枫蓝
  1. rom

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  2. 该源码是基于查找表的VHDL代码实现DDS-The source code is based on the VHDL code look-up table DDS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:651385
    • 提供者:allen-haha
  1. dds32_1

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  2. 频率合成器实例模块设计。频率分辨率为32位DDS的VHDL程序-Frequency synthesizer module design example. 32-bit DDS frequency resolution of the VHDL program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:898
    • 提供者:hucy
  1. digital-frequency-meter

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  2. VHDL实现的 数字频率计 数字频率合成DDS-VHDL implementation of the digital frequency meter DDS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:3233
    • 提供者:zeng32
  1. fpga_example

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  2. EDA技术和VHDL语言实用模块设计,点击驱动,dds,频率计-EDA technology and VHDL functional module design, click the drive, dds, frequency meter, etc.,,,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-09
    • 文件大小:1574651
    • 提供者:Jasen
  1. DDS_PHASE

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  2. 基于DDS BUILDER和VHDL写的数字移相信号源,经DA实测760Hz波形良好,手里没有高速DA,未能继续测试。仅供参考-DDS BUILDER and VHDL-based digital phase shift number written sources, 760Hz waveform measured by the DA good hands there is no high-speed DA, unable to continue testing. Reference
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1228601
    • 提供者:张天翼
  1. dds1

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  2. 本历程使用FPGA根据DDS原理使用VHDL语言编译成功的产生一些固定频率的DDS-The process of using the FPGA using the VHDL language according to the principle DDS compile successfully produce some fixed frequency of the DDS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:638555
    • 提供者:陈默
  1. ddc_easy

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  2. 简单的DDC实现,包括了DDS MIXER 等部分采用的VHDL语言-The implementation of DDC using vhdl hardware descr iption language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:39898
    • 提供者:
  1. DDS_VHDL

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  2. 基于VHDL的DDS程序。仅存储了四分之一周期的数据,优化的DDS。-VHDL-based DDS program. Only a quarter cycle of data storage, optimization of DDS.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1669264
    • 提供者:张天翼
  1. ALTERA@FPGA@example

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  2. 基于ALTERA的几个VHDL实例,如FPGA单片机,DDS的正弦信号发生器,FPGA视频监控-VHDL example:such as DDS Sine signal generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-17
    • 文件大小:27246957
    • 提供者:bin
  1. dds_project_FPGA_VHDL

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  2. 基于FPGA的DDS波形发生器,VHDL,EP2C8Q208C8N-DDS waveform generator based on FPGA, VHDL, EP2C8Q208C8N
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6826212
    • 提供者:fei
  1. gf

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  2. DDS use AD9852 with vhdl for director
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:1244
    • 提供者:sn
  1. design

    0下载:
  2. 基于vhdl的dds发生器,精度可达到1Hz,包含正弦波,三角波,方波-DDS based on VHDL,display resolution 1Hz, include sine wave,triangular wave, square wave
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:400827
    • 提供者:海蓝漂流瓶
  1. dds3

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  2. 有复位的DDS 实现平台为spartan-3e vhdl fpga,输出到led,coe文件由matlab产生-Reset the DDS platform spartan 3e VHDL fpga, output to led coe file from matlab
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:2057920
    • 提供者:朱飞亚
  1. dds_vhdl

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  2. DDS的VHDL程序,相当好,值得下载,共享才是王道-DDS, VHDL program is quite good, worth downloading, sharing is king
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:631
    • 提供者:cheng
  1. test

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  2. 利用VHDL 编程AD9910 产生DDS -Use of the VHDL programming AD9910 DDS
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:418594
    • 提供者:helen
  1. 9

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  2. dds xinhaofashengqi quartus vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-15
    • 文件大小:3719664
    • 提供者:简希
  1. ep1c12_29_dds

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  2. DDS设计:该程序完成了在Quartus Ⅱ上使用VHDL语言实现的DDS波形调制设计-DDS Design: The procedure is completed in Quartus ii the DDS waveform modulation design using VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-24
    • 文件大小:494785
    • 提供者:无敌县令
  1. dds_mixer

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  2. 包括dds的产生 已经混频 里面包括详细的仿真 以及matlab验证-dds mixer matlab vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-25
    • 文件大小:7539695
    • 提供者:孙范瑞
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