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搜索资源列表

  1. VHDL

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  2. 3-8译码器 4-2优先编码器 4选1多路选择器-3-8 4-2 priority encoder decoder 4-to-1 multiplexer
  3. 所属分类:assembly language

    • 发布日期:2017-04-26
    • 文件大小:119749
    • 提供者:陈增涛
  1. VHDL-code

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  2. 使用VHDL语言进行门电路,优先编码器,译码器,各进制计数器,数码管显示的编写,在QUARTUS ii上模拟可用-Gates using VHDL language, priority encoder, decoder, each binary counter, write digital display, analogue available on QUARTUS ii
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1246
    • 提供者:lucy
  1. encoder

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  2. encoder in vhdl using behavioral modelling
  3. 所属分类:VHDL编程

    • 发布日期:2014-02-28
    • 文件大小:124162
    • 提供者:priyanka
  1. Run-length-encoder

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  2. vhdl code for run length encoder
  3. 所属分类:Other systems

    • 发布日期:2017-04-12
    • 文件大小:1460
    • 提供者:Amith
  1. VHDL

    0下载:
  2. 数字电路中常用的3线-8线译码器及8线-3线优先编码器的VHDL语言的功能描述-That is commonly used in digital circuit lines to 3-8 8 line to 3 line priority encoder decoder and the function of the VHDL language descr iption
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2653
    • 提供者:王宝
  1. Priority-encoder

    0下载:
  2. 用VHDL语言编程来实现优先编码器的功能。-VHDL language programming to achieve priority encoder function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:2809
    • 提供者:谭莉
  1. bch_codeword11

    0下载:
  2. 3072 to 3240 vhdl encoder source code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:720
    • 提供者:Mojtaba
  1. convolutional-encoder

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  2. In this case is a convolutional encoding code for decoding the convolutional code, using VHDL language. This code provide the method of convolutional encoding for input data. (2,1,7)
  3. 所属分类:Modem program

    • 发布日期:2017-04-09
    • 文件大小:614
    • 提供者:kimdaeyoung
  1. PRIORITY-ENCODER

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  2. this the vhdl code fot 4:2 priority encoder-this is the vhdl code fot 4:2 priority encoder
  3. 所属分类:Project Design

    • 发布日期:2017-04-26
    • 文件大小:17541
    • 提供者:asif patel
  1. RS-encoder

    0下载:
  2. RSC encoder in VHDL. Hope it helpful.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3871
    • 提供者:thang
  1. seven-segment-encoder

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  2. 七段译码器,实现七段译码器的显示功能,使用VHDL语言写成-seven-segment encoder
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:269011
    • 提供者:hp
  1. encoder

    0下载:
  2. VHDL Code for D-Flip Flop & Matching Unit
  3. 所属分类:Compiler program

    • 发布日期:2017-04-14
    • 文件大小:4080
    • 提供者:Mohammed Ismail
  1. encoder

    0下载:
  2. Encoder is written in VHDL. This is simulated using ISIM and synthesized with ISE
  3. 所属分类:Other systems

    • 发布日期:2017-04-12
    • 文件大小:676
    • 提供者:mehdi
  1. Convolutional-encoder-VHDL-code-_-VHDL-Programmin

    0下载:
  2. convolutional encoder in vhdl
  3. 所属分类:Communication

    • 发布日期:2017-04-29
    • 文件大小:335220
    • 提供者:sampath
  1. Gray-code-encoder

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  2. 1、 了解格雷码变换的原理。 2、 进一步熟悉QUARTUSII软件的使用方法和VHDL输入的全过程。 3、 进一步掌握实验系统的使用。 -Gray code encoder VHDL-based design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:101247
    • 提供者:漆广文
  1. encoder

    0下载:
  2. vhdl code encoder that has a rate of half (rate = 1/2) and an example of code with its test bench
  3. 所属分类:Algorithm

    • 发布日期:2017-04-13
    • 文件大小:1827
    • 提供者:Mostafa Helal
  1. rsencoder_latest.tar

    0下载:
  2. Reed Solomon Encoder
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-21
    • 文件大小:3072
    • 提供者:aprsc7
  1. 1

    1下载:
  2. VHDL代码,一些课本的小程序。包含3线-8线译码器,4选1选择器,6层电梯,8线-3线编码器,8线-3线优先编码器,8选1,BCD-7段显示译码器真值表,半加器,摩尔状态机,数字频率计,数字时钟,序列检测器的设计,一般状态机等等。(VHDL code, some textbooks for small programs. Includes 3 -8 decoder, 4 1 selector, 6 elevator, line 8 Line 8 line -3 encoder, -3 prio
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-22
    • 文件大小:453632
    • 提供者:zidting
  1. 2

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  2. VHDL代码,一些课本的小程序。包含3线-8线译码器,4选1选择器,6层电梯,8线-3线编码器,8线-3线优先编码器,8选1,BCD-7段显示译码器真值表,半加器,摩尔状态机,数字时钟,序列检测器的设计,一般状态机等等。(VHDL code, some textbooks for small programs. It includes 3 line -8 line decoder, 4 selector 1 selector, 6 elevator, 8 line -3 encoder, 8 l
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-23
    • 文件大小:454656
    • 提供者:zidting
  1. EDA

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  2. 本设计是在Quartus ii开发环境下采用VHDL语言实现的AMI/HDB3编码器课程设计。(This design is a course design of AMI / HDB3 encoder implemented by VHDL language in the development environment of Quartus II.)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-08-31
    • 文件大小:1916928
    • 提供者:Z Yu
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