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搜索资源列表

  1. LCDtime

    1下载:
  2. 基于DE2板子上EP4CE115F29C7的用lcd1602显示时钟的VHDL语言,其显示的内容是时分秒,达到23:59:59后全部归零,重新计时。-Based on the DE2 board EP4CE115F29C7 use lcd1602 display clock VHDL language, its display when the content of the minutes, after reaching 23:59:59 all return to zero, the timi
  3. 所属分类:Other windows programs

    • 发布日期:2017-05-29
    • 文件大小:12204714
    • 提供者:小师
  1. EP2C70F896C6N-pins

    0下载:
  2. 将VHDL程序下载到DE2开发板,引脚分配时需要知道的芯片每个引脚功能-VHDL program will be downloaded to the DE2 development board, you need to know when the pin assignments for each pin of the chip functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:417351
    • 提供者:zyq
  1. LCD-controller---Nghia

    0下载:
  2. different code for lcd controller using de2 board with vhdl lanuage
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:682811
    • 提供者:Nghia
  1. Quartus_FPGA_detect

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  2. this a simple VHDL code on quartus that can detect a sequence of binary input, this files contain an DE2 pins assignements -this is a simple VHDL code on quartus that can detect a sequence of binary input, this files contain an DE2 pins assigne
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:316151
    • 提供者:takachy
  1. DE2_70_D5M1

    0下载:
  2. fpga,vhdl,de2-70,数字摄像头-fpga, vhdl, de2-70, a digital camera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:154499
    • 提供者:lee
  1. SRAM

    0下载:
  2. DE2-35 SRAM简单读写VHDL源码,可以通过开发板上拨动开关输入数据,在LED上显示读写情况-DE2-35 SRAM to read and write simple VHDL source code, can input data through the development board to toggle switch, display to read and write in LED.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:223791
    • 提供者:ft
  1. VGA_DATA

    0下载:
  2. Create VGA module using VHDL on Altera DE2. It is better if you understand the full theory of VGA.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1530985
    • 提供者:lizhi
  1. PLL_1

    0下载:
  2. Phase lock loop generation for vhdl (DE2 board)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-11
    • 文件大小:2099632
    • 提供者:chow
  1. digital_clk

    0下载:
  2. VHDL Code for a digital bit clock counter and 7 segment display clock on a altera DE2 board with a cyclone II FPGA
  3. 所属分类:Other systems

    • 发布日期:2017-05-03
    • 文件大小:949863
    • 提供者:Casey
  1. hex7segb

    0下载:
  2. Implimentation of the switches and 7 segment display bit counter on an Altera DE2 baord via VHDL code on the Cyclone II FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-26
    • 文件大小:345977
    • 提供者:Casey
  1. LCD

    0下载:
  2. LCD的循环输出,在Quartus二的环境下进行开发,DE2-70的开发板,用VHDL语言编写-LCD de xúnhuán shūchū, zài Quartus èr de huánjìng xià jìnxíng kāifā,DE2-70 de kāifā bǎn, yòng VHDL yǔyán biānxiě
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-03
    • 文件大小:627551
    • 提供者:王鲁苏
  1. infrastructure.vhd

    0下载:
  2. infrastructure block for analog loop, vhdl, fpga, de2
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-12
    • 文件大小:574
    • 提供者:aabdelwa
  1. DE2_Basic_Computer

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  2. DE2 altera board vhdl design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:1820
    • 提供者:hadjer.az
  1. stopWatch

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  2. 基于VHDL语言数字秒表的实现!使用模块化的设计,包含详细设计说明文档。可在DE2-115开发板上进行验证!-digital stop watch based on VHDL language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-30
    • 文件大小:493326
    • 提供者:顾庆水
  1. 99multiply

    0下载:
  2. 99乘法表,VHDL编写,原理图和代码齐全,仿真和DE2板子都经过测试,可成功运行-99 multiplication table, write by VHDL, simulation and DE2 board have been tested to run successfully
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-07
    • 文件大小:1252337
    • 提供者:yang
  1. hex-2-led

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  2. 基于VHDL的数码管点亮实验,针对DE2开发板-Digital tube experiments based on VHDL for DE2 board
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:299939
    • 提供者:ziyang
  1. puerto-Uart-rs232

    0下载:
  2. UART PORT VHDL USING DE2-115
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-05
    • 文件大小:161333
    • 提供者:crisalex
  1. VGA_SHOW

    0下载:
  2. 利用VHDL语言基于DE2-115的开发板在显示器上实现自选图片的显示。-Using VHDL language based DE2-115 development board on display managed to achieve image display.
  3. 所属分类:HardWare Design

    • 发布日期:2017-05-09
    • 文件大小:1567651
    • 提供者:Wang Yibing
  1. LTM_timing_controller

    0下载:
  2. vhdl file used for de2 soc to be completed
  3. 所属分类:Other systems

    • 发布日期:2017-04-12
    • 文件大小:1167
    • 提供者:trixxl
  1. booth

    0下载:
  2. it's booth vhdl code for DE2 altra boards
  3. 所属分类:其他

    • 发布日期:2017-12-20
    • 文件大小:549888
    • 提供者:hosseinkhani
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