搜索资源列表
Crack_QII70
- Quartus II 7.0 crack
AND_TOP
- Simple 7 segment up-counter for Quartus II 4.
SPL_TOP
- 7 segment up-counter for Quartus II 4.
PipelineCPU
- Quartus II 7.2环境中，采用硬件描述语言VHDL独立完成了基于MIPS指令集的32位RISC处理器的逻辑设计-quartusII mips pipeline 32bit cpu design
Crack_QII10.0_x86
- Quartus II 10.0_x86版破解补丁，此补丁在Windows XP和Windows 7的32/64位操作系统下都验证过了，都能使软件流畅运行-Quartus II 10.0_x86 Edition crack patch, this patch in Windows XP and Windows 7, 32/64 bit operating systems are verified, and can make the software run smoothly
clock
- 用vhdl写的数字电子时钟，能够定闹钟，定点报时，调时，用Quartus II 7.2 (32-Bit)写的，压缩文件，里面有源程序，仿真文件等（就是所建的工程）-Digital electronic clock vhdl write, to set the alarm clock, designated chime tune, written using Quartus II 7.2 (32-Bit), compressed files, source code and simulation
Example-b8-2
- 使用ModelSim对Altera设计进行时序仿真的简要操作步骤 1.建立工程，设置仿真工具选项参数 2.使用Quartus II编译工程 3.建立仿真工程 4.Altera仿真库的编译与映射 5.编译HDL源代码和Testbench 6.启动仿真器并加载设计顶层 7.打开观测窗口，添加信号 8.执行仿真-Using ModelSim Altera design for timing simulation of brief steps 1. Establish pro
HM74BM
- 在QUARTUS II上实现（7,4）汉明码编码VHDL语言设计-(7,4)Hamming encode
HM74YM
- 在QUARTUS II上实现（7,4）汉明码的译码VHDL语言设计-(7,4)Hamming decoder
Digital-Frequency-Meter
- 该数字频率计使用EDA软件QUARTUS II编写，实现以下的3个功能： 1. 测试频率范围为：1Kz~99999999Hz， 2. 基准信号频率为1MHz； 3. 用8位十进制7段数码显示译码器显示所测信号的频率值。 -The digital frequency meter using EDA software QUARTUS II prepared to fulfill the following three functions: 1. Test frequency rang