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搜索资源列表

  1. Low_power_Modified_Booth_Multiplier

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  2. 主題 : Low power Modified Booth Multiplier 介紹 : 為了節省乘法器面積、加快速度等等,許多文獻根據乘法器中架構提出改進的方式,而其中在1951年,A. D. Booth教授提出了一種名為radix-2 Booth演算法,演算法原理是在LSB前一個位元補上“0”,再由LSB至MSB以每兩個位元為一個Group,而下一個Group的LSB會與上一個Group的MSB重疊(overlap),Group中的位元。 Booth編碼表進行編碼(Booth
  3. 所属分类:汇编语言

    • 发布日期:2008-10-13
    • 文件大小:14123
    • 提供者:stanly
  1. multi16

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  2. 有符号16位乘法器。经典booth编码。拓扑结构为wallance树。加法器类型是进位选择加法器。-Number system: 2 s complement Multiplicand length: 16 Multiplier length: 16 Partial product generation: PPG with Radix-4 modified Booth recoding Partial product accumulation: Wallace t
  3. 所属分类:MPI

    • 发布日期:2017-11-18
    • 文件大小:48852
    • 提供者:周晓生
  1. 16bit-booth-multiplier

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  2. 16bit booth multiplier
  3. 所属分类:MPI

    • 发布日期:2017-04-12
    • 文件大小:723
    • 提供者:francis
  1. 32bit_multiply

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  2. 包含32为乘法器的设计,用verilog语言实现,包括booth编码的实现,booth乘法器的实现,3_2压缩器的实现,4_2压缩器的实现,华伦斯树的实现,以及两个testbench文件用于测试。-Contains 32 multiplier design, verilog language, including booth encoding implementations, booth multiplier implementations, 3_2 compressor implementat
  3. 所属分类:MPI

    • 发布日期:2017-04-14
    • 文件大小:4101
    • 提供者:DX
  1. eetop.cn_Booth_mutipler_v2

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  2. 新型32位booth乘法器的实现,使用verilog的一种新型乘法器改进实现-The new 32 booth multiplier implementations
  3. 所属分类:MPI

    • 发布日期:2017-05-02
    • 文件大小:692337
    • 提供者:DX
  1. booth

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  2. 简易明了的booth算法乘法器,实现4x4的快速乘法计算;-Simple and straightforward booth multiplier algorithm to achieve the 4x4 multiplication
  3. 所属分类:MPI

    • 发布日期:2017-04-14
    • 文件大小:2992
    • 提供者:kang
  1. booth

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  2. 基于booth算法的16位乘法器,通过减少部分积的运算次数提升速度。(The 16 bit multiplier based on the Booth algorithm improves the speed by reducing the number of arithmetic times of the partial product.)
  3. 所属分类:中间件编程

    • 发布日期:2018-01-08
    • 文件大小:1024
    • 提供者:JoincoreX
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