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搜索资源列表

  1. floating_point_adder

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  2. 该代码描述了一个浮点加法器的功能,浮点格式采用IEEE标准-The code describes a floating-point adder function, the use of IEEE standard floating-point format
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:1372
    • 提供者:钟毓秀
  1. fpadd

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  2. Floating point adder
  3. 所属分类:Windows Develop

  1. Floating-Point-Adder

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  2. 浮点数加法器IP核的vhd设计。浮点数加法运算是运输中使用最高的运算,结合vhdl和EPGA可编程技术,完成具有5线级流水线结构、符合IEEE 754浮点标准、可参数化为单、双精度的浮点数加法器。-Floating point adder design IP core vhd. Floating-point addition operation is used in most transport operations, combined with vhdl and EPGA programmab
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-22
    • 文件大小:154913
    • 提供者:凌音
  1. fpufiles

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  2. floating point adder mul and sub in verilog code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:19233
    • 提供者:khosro raja
  1. floating-point-adder-subtractor

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  2. floating point adder/subtractor in VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:3190
    • 提供者:abeymohammed
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