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搜索资源列表

  1. floatadd

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  2. 浮点数加法器的源代码,实现浮点数的加法功能，浮点数遵循的是IEEE745标准-floating_piont addition

  3. 所属分类：VHDL-FPGA-Verilog

    • 发布日期：2017-03-28
    • 文件大小：11068
    • 提供者：张妮娜

  1. IEEE_Verilog_2001

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  2. Verilog 2001 编程规范，作为ASIC和FPGA逻辑开发人员学习不可多得的资料，也可以作为逻辑开发高手们学习查阅的工具。新手们可以按照实例自己编程操练。

  3. 所属分类：软件工程

    • 发布日期：2013-06-21
    • 文件大小：2236869
    • 提供者：徐杰猛
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