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搜索资源列表

  1. sin-lookup-table

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  2. 基于嵌入式的正弦查表程序.在sintable.asm中定义的正弦表.系统频率设置49.152MHz,强振模式.-based embedded sine chat program. Sintable.asm defined in the sine table. System set the frequency 49.152 MHz, strong vibration mode.
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:9360
    • 提供者:kevin
  1. DDS_Power

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  2. FPGA上的VERILOG语言编程。通过查找表实现直接数字频率合成。在主控部分通过键盘选择正弦波,方波,三角波,斜波,以及四种波形的任意两种的叠加,以及四种波形的叠加;通过控制频率控制字C的大小,以控制输出波形频率,实现1Hz的微调;通过地址变换实现波形相位256级可调;通过DAC0832使波形幅值256级可调;通过FPGA内部RAM实现波形存储回放;并实现了每秒100HZ扫频。-FPGA on the verilog language programming. Lookup table thr
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:16232
    • 提供者:田世坤
  1. dsp-sin

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  2. 汇编语言产生的查表法实现正弦波发生器的程序,需要的下载。-Assembly language generated by sine wave generator look-up table method implementation procedures, the required download.
  3. 所属分类:assembly language

    • 发布日期:2017-03-26
    • 文件大小:1540
    • 提供者:杨树涛
  1. address_sin

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  2. 正弦值查找表是用matlab代码写的,根据量化地址来查找实际地址的正弦值-Sine value lookup table is written in matlab code, according to quantify the address to find the actual address of the sine value
  3. 所属分类:matlab

    • 发布日期:2017-03-29
    • 文件大小:1129
    • 提供者:文书
  1. sin_cos_lookup_generator

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  2. Generator of sine and cosine lookup tables in Matlab.
  3. 所属分类:Energy industry

    • 发布日期:2017-03-29
    • 文件大小:2771
    • 提供者:Evgenije
  1. SineWaveGeneration

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  2. This zip folder contains the sine wave generation using lookup table. Implemenated on BF533 VDSP-This zip folder contains the sine wave generation using lookup table. Implemenated on BF533 VDSP++
  3. 所属分类:DSP program

    • 发布日期:2017-03-23
    • 文件大小:47121
    • 提供者:Jaganathan
  1. vhdl2

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  2. vhdl语言正弦信号发生器设计,传统的用分立元件或通用数字电路元件设计电子线路的方法设计周期长,花费大, 可移植性差。本文以正弦波发生器为例,利用EDA 技术设计电路,侧重叙述了用VHDL 来完 成直接数字合成器(DDS) 的设计,DDS 由相位累加器和正弦ROM 查找表两个功能块组成,其 中ROM查找表由兆功能模块LPM-ROM来实现。-The traditional use of discrete components or general purpose digital cir
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:94354
    • 提供者:枫蓝
  1. ROM

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  2. Verilog sine的查找表,相信大家会用到-Verilog sine lookup table, I believe we will use
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:3277
    • 提供者:wuzhongpeng
  1. SG_FPGA

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  2. 2006年电子设计竞赛二等奖,多功能函数、信号发生器核心器件FPGA内部的原理图,主要模块用VHDL代码描述,包括PLL、相位累加器、波形算法和正弦波查找表,可实现0.005Hz~20MHz的多波形信号产生,频率步进值0.005,输出接100MSPS速率的DAC--AD9762-Electronic Design Competition 2006, second prize, multi-function signal generator within the core of the devic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1099880
    • 提供者:zlz
  1. Rendering primitives

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  2. Some 2D graphic rendering in VHDL: - Line - Draw a line - Circle - Draw circle - BitBLT - Draw a rectangle - Sine and cosinus lookup tables - Rotation - Rotate line
  3. 所属分类:VHDL编程

    • 发布日期:2012-11-30
    • 文件大小:13600
    • 提供者:lance_corona
  1. DDS4.mdl

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  2. DDS(快速正交调制)生成正弦波形,利用相位累加字进行累加,查找查找表内容输出正弦数据,在通信领域应用很多,我采用的是matlab的simulink进行前期仿真-DDS (fast quadrature modulation) to generate sine wave, the use of the word to accumulate phase accumulation, content output sine lookup table lookup data in many applic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:11910
    • 提供者:lu
  1. DDS

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  2. DDS信号生成模块,使用MATLAB产生查找表,可输出方波、三角波、锯齿波、正弦波-DDS signal generator module, using MATLAB to generate a lookup table can output square wave, triangle wave, sawtooth, sine
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-26
    • 文件大小:8883596
    • 提供者:苏杭
  1. DDS

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  2. 本设计基于数字频率合成技术,采用正弦查找表实现波形产生.直接数字频率合成技术(DDS)是一种先进的电路结构,能在全数字下对输出信号频率进行精确而快速的控制,DDS技术还在解决输出信号频率增量选择方面具有很好的应用,DDS所产生的信号具有频率分辨率高、频率切换速度快、频率切换时相位连续、输出相位噪声低和可以产生任意波形等诸多优点。 文中介绍了DDS的基本原理,对DDS的质谱及其散杂抑制进行了分析。程序设计采用超高速硬件描述语言VHDL描述DDS,在此基础上设计了正弦波、三角波、方波等信号发生器,。
  3. 所属分类:Other windows programs

    • 发布日期:2017-05-17
    • 文件大小:4485169
    • 提供者:冯阳
  1. lab11

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  2. 在dac 上显示一个波图,刚刚输出的时候是sine 的图 开动按钮后发出不同的图像-Write a C program that creates a waveform generator. It should start by outputting a sine wave to DAC0. Each time SW1 is pressed then released, the wave form should change, first to a triangle wave, then
  3. 所属分类:SCM

    • 发布日期:2017-04-13
    • 文件大小:2532
    • 提供者:kailing
  1. sin_en

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  2. DDS 由相位增量器,相位累加器,量化器以及正余弦查找表四部分组成。 相位累加器每一周期会累加上固定的相位值,然后从查找表中找到对应的数值。-DDS by the phase increment, phase accumulator, quantizer and sine and cosine lookup table of four parts. The phase accumulator accumulates a fixed phase value for each period,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:2712174
    • 提供者:panda
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