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  1. dc_rmv

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  2. 这是一个用verilog写的DC滤波器,即melp算法中预处理部分,主要滤除50hz工频干扰,采用一个4阶的切比雪夫高通滤波器,截去频率位60hz以下的信号,其阻带的衰减位30db。-This is a verilog to write a DC filter the preprocessing part that melp algorithm, main filter 50hz frequency interference, the use of a fourth-order Chebyshe
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-14
    • 文件大小:4755746
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