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  1. 异步FIFO

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  2. 纯Verilog实现的异步FIFO,分为读写控制模块,SRAM CORE,同步等几个模块,内含源文件和仿真文件(The asynchronous FIFO implemented by Verilog is divided into read-write control module, SRAM core module and synchronization module)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2020-12-08
    • 文件大小:2048
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