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  1. dsppart34

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  2. From the partial fraction expansion of H(z) we can find a, b
  3. 所属分类:matlab

    • 发布日期:2017-04-29
    • 文件大小:8469
    • 提供者:Nabeel
  1. SAF_VS2003Backup

    0下载:
  2. 应用框架的设计与实现NET平台书本的源码,计算机编程的学习重要的是看完书后,调试代码看看,这样才能学习更快进步!-Application Framework Design and Implementation of NET platform source of books, learning computer programming is important to read the book, look at the debug code in order to learn faster pro
  3. 所属分类:Network Security

    • 发布日期:2017-04-28
    • 文件大小:221226
    • 提供者:yang
  1. Task01

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  2. this a relatively simple program. -this is a relatively simple program.
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-07
    • 文件大小:1615
    • 提供者:hassaanbinaslam
  1. keybroadcatch

    0下载:
  2. 可用键盘控制元件上下左右移动-Keyboard can be used to control vertical and horizontal components of mobile ...................
  3. 所属分类:Other systems

    • 发布日期:2017-04-15
    • 文件大小:5633
    • 提供者:joily
  1. Task02

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  2. this a relatively simple program. -this is a relatively simple program.
  3. 所属分类:Windows Develop

  1. concurrent_thread.c

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  2. tcpip programing in unix using sockets. networking program
  3. 所属分类:Linux Network

    • 发布日期:2017-04-12
    • 文件大小:1479
    • 提供者:chirag
  1. DSppart12

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  2. From the partial fraction expansion of H(z) we can find a, b
  3. 所属分类:matlab

    • 发布日期:2017-04-28
    • 文件大小:8670
    • 提供者:Nabeel
  1. Task03

    0下载:
  2. this a relatively simple program. -this is a relatively simple program.
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-14
    • 文件大小:3171
    • 提供者:hassaanbinaslam
  1. paobiao

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  2. 一个基于FPGA的数字跑表系统的设计,最小单位是百分表位。采用十进制进位。-FPGA-based digital stopwatch system design, the smallest unit is a digital dial indicator. Binary using the metric system.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:43860
    • 提供者:jyb
  1. FrameSwap

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  2. this a relatively simple program.-this is a relatively simple program.
  3. 所属分类:WAP develop

    • 发布日期:2017-04-03
    • 文件大小:4330
    • 提供者:hassaanbinaslam
  1. DSpproject3

    0下载:
  2. 1. Consider the FIR system described by H(z) = 1/16(-1 + 9z--2 + 16z-3 + 9z--4 - z-6), and plot the pole-zero locations in the z-plane.-1. Consider the FIR system described by H(z) = 1/16(-1+ 9z--2+ 16z-3+ 9z--4- z-6), and plot the pole-zero location
  3. 所属分类:matlab

    • 发布日期:2017-04-27
    • 文件大小:8836
    • 提供者:Nabeel
  1. jtd

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  2. 这个是用verilog语言编写的基于FPGA的交通灯控制器,分别控制四个方向上的交通灯的通断-The verilog language is FPGA-based traffic light controller, respectively, the four direction control of traffic lights-off
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:48263
    • 提供者:jyb
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