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文件名称:yiweijicunqi

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2016-03-13
  • 文件大小：
    1.67kb
  • 已下载：
    0次
  • 提 供 者：
    曾***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

设计了一个简单的移位寄存器，每接收到一位数据后寄存器自动向左移动一位。-To achieve a simple shift register, each received a data register automatically moved to the left one.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

移位寄存器/tb.v
移位寄存器/yiwei.v
移位寄存器/

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