文件名称:freq
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- 上传时间:2012-11-16
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应用VHDL语言设计低频数字频率计,选择测频法方案,主要是控制电路,由其产生闸门、清零和锁存等信号。-VHDL, design low frequency digital frequency meter, select the frequency method to program, mainly the control circuit, produced by the gate and the latch so clear signal.
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频率计VHDL语言描述及仿真.doc
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