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文件名称:VHDL-0.1s-Timer

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    64.84kb
  • 已下载：
    0次
  • 提 供 者：
    kop***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

该程序完成了在altera de2 环境下实现0.1s新型计时器，该计时器可以运用于广大体育赛事中，有开关、暂停开始键、复位键。-The program completed the implementation in altera de2 0.1s under the new timer, which can be applied to the majority of sports events, a switch, pause start button, reset button.
相关搜索： de2

(系统自动生成,下载前可以参看下载内容)

下载文件列表

VHDL 0.1s Timer/db/DE2_Clock.db_info
VHDL 0.1s Timer/db/DE2_Clock.eco.cdb
VHDL 0.1s Timer/db/DE2_Clock.sld_design_entry.sci
VHDL 0.1s Timer/DE2_Clock.asm.rpt
VHDL 0.1s Timer/DE2_CLOCK.cdf
VHDL 0.1s Timer/DE2_Clock.done
VHDL 0.1s Timer/DE2_Clock.fit.eqn
VHDL 0.1s Timer/DE2_Clock.fit.rpt
VHDL 0.1s Timer/DE2_Clock.fit.summary
VHDL 0.1s Timer/DE2_Clock.flow.rpt
VHDL 0.1s Timer/DE2_Clock.map.eqn
VHDL 0.1s Timer/DE2_Clock.map.rpt
VHDL 0.1s Timer/DE2_Clock.map.summary
VHDL 0.1s Timer/DE2_Clock.pin
VHDL 0.1s Timer/DE2_Clock.qpf
VHDL 0.1s Timer/DE2_Clock.qsf
VHDL 0.1s Timer/DE2_Clock.qws
VHDL 0.1s Timer/DE2_CLOCK.sof
VHDL 0.1s Timer/DE2_Clock.tan.rpt
VHDL 0.1s Timer/DE2_Clock.tan.summary
VHDL 0.1s Timer/DE2_CLOCK.vhd
VHDL 0.1s Timer/DE2_CLOCK.vwf
VHDL 0.1s Timer/DE2_Clock_assignment_defaults.qdf
VHDL 0.1s Timer/db
VHDL 0.1s Timer

相关说明

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