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文件名称:Faraday_rtl

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    556.37kb
  • 已下载:
    0次
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    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

These designs were developed by Faraday Technology Corporation, a fabless ASIC vendor and silicon Intellectual property (SIP) provider in order.-Faraday Technology Corporation, a fabless ASIC vendor and silicon Intellectual property (SIP) provider in order.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

DMA/hdl/dma_ahbdec.v
DMA/hdl/dma_ahbmst.v
DMA/hdl/dma_ahbmux.v
DMA/hdl/dma_ahbslv.v
DMA/hdl/dma_chrf.v
DMA/hdl/dma_chsel.v
DMA/hdl/dma_ctlrf.v
DMA/hdl/DMA_DEFINE.vh
DMA/hdl/dma_engine.v
DMA/hdl/dma_fifo.v
DMA/hdl/DMA_FIX_DEFINE.vh
DMA/hdl/dma_rrarb.v
DMA/hdl/dma_top.v
DMA/syn/script/ahb_timing.tcl
DMA/syn/script/env.tcl
DMA/syn/script/fdma.tcl
DMA/syn/script/readme.txt
DMA/syn/script/read_design.scr
DSP/hdl/BDMA/m_bdma.v
DSP/hdl/BDMA/m_bdma_dummy.v
DSP/hdl/BTB/c_btb.v
DSP/hdl/BTB/c_btb_dummy.v
DSP/hdl/BTB/m_btbmemx.v
DSP/hdl/BTB/m_rtbmemx.v
DSP/hdl/BTB/reg
DSP/hdl/CODEC/FXADDA162H90A/ADC162H90A_dtop.v
DSP/hdl/CODEC/FXADDA162H90A/ADDA162H90A_atop.v
DSP/hdl/CODEC/FXADDA162H90A/ADDA162H90A_atop.v.src
DSP/hdl/CODEC/FXADDA162H90A/DAC162H90A_dtop.v
DSP/hdl/CODEC/FXADDA162H90A/dac_48k_16b_1875_0db.in
DSP/hdl/CODEC/FXADDA162H90A/dac_48k_16b_937_0db.in
DSP/hdl/CODEC/FXADDA162H90A/decode.v
DSP/hdl/CODEC/FXADDA162H90A/fir_8x.v
DSP/hdl/CODEC/FXADDA162H90A/FS90B779.v
DSP/hdl/CODEC/FXADDA162H90A/FS90B779_DAI.v
DSP/hdl/CODEC/FXADDA162H90A/FS90B779_DAI_loop.v
DSP/hdl/CODEC/FXADDA162H90A/FS90B779_sim.v
DSP/hdl/CODEC/FXADDA162H90A/FXADDA162H90A.v
DSP/hdl/CODEC/FXADDA162H90A/FXADDA162H90A.v.src
DSP/hdl/CODEC/FXADDA162H90A/FXADDA162H90A_syn.v
DSP/hdl/CODEC/FXADDA162H90A/header.v
DSP/hdl/CODEC/FXADDA162H90A/MCLK_Delay.v
DSP/hdl/CODEC/FXADDA162H90A/ram_32_44.v
DSP/hdl/CODEC/FXADDA162H90A/run2
DSP/hdl/DAG/d_adder15.v
DSP/hdl/DAG/d_cla15.v
DSP/hdl/DAG/d_csa15.v
DSP/hdl/DAG/d_csa_d.v
DSP/hdl/DAG/d_dag.v
DSP/hdl/DAG/d_ILM1reg.v
DSP/hdl/DAG/d_ILM2reg.v
DSP/hdl/DAG/d_lpn.v
DSP/hdl/DAG/d_moduloL1.v
DSP/hdl/DAG/d_moduloL2.v
DSP/hdl/DEC/c_dec.v
DSP/hdl/DFT/wrapper.v
DSP/hdl/EU/ALU/ea_alu.v
DSP/hdl/EU/ALU/ea_core.v
DSP/hdl/EU/ALU/ea_dec.v
DSP/hdl/EU/ALU/ea_reg.v
DSP/hdl/EU/ALU/e_eu.v
DSP/hdl/EU/CUN/ec_cun.v
DSP/hdl/EU/MAC/em_adder.v
DSP/hdl/EU/MAC/em_array.v
DSP/hdl/EU/MAC/em_core.v
DSP/hdl/EU/MAC/em_dec.v
DSP/hdl/EU/MAC/em_mac.v
DSP/hdl/EU/MAC/em_mvovf.v
DSP/hdl/EU/MAC/em_part.v
DSP/hdl/EU/MAC/em_psel_part.v
DSP/hdl/EU/MAC/em_reg.v
DSP/hdl/EU/SHT/es_array.v
DSP/hdl/EU/SHT/es_dec.v
DSP/hdl/EU/SHT/es_exp.v
DSP/hdl/EU/SHT/es_reg.v
DSP/hdl/EU/SHT/es_sht.v
DSP/hdl/ICE/i_sice.v
DSP/hdl/ICE/i_sice_dummy.v
DSP/hdl/ICE/x_parser.v
DSP/hdl/ICE/x_parsm.v
DSP/hdl/IDMA/m_idma.v
DSP/hdl/IDMA/m_idma_dummy.v
DSP/hdl/LIB/idebn.v
DSP/hdl/LIB/m_cm4k.v
DSP/hdl/LIB/m_cm8k.v
DSP/hdl/LIB/m_dm8k.v
DSP/hdl/LIB/m_ecm32kx24.v
DSP/hdl/LIB/m_edm8k.v
DSP/hdl/LIB/m_eeprom.v
DSP/hdl/LIB/m_eio2k.v
DSP/hdl/LIB/m_em4k.v
DSP/hdl/LIB/m_em8k.v
DSP/hdl/LIB/m_pm4k.v
DSP/hdl/LIB/x_gclk_lib.v
DSP/hdl/LIB/x_lib.v
DSP/hdl/MEMC/m_emc.v
DSP/hdl/MEMC/m_emc_dummy.v
DSP/hdl/MEMC/m_memc.v
DSP/hdl/PIO/pio.v
DSP/hdl/PIO/pio_dummy.v
DSP/hdl/PSQ/c_cntstk.v
DSP/hdl/PSQ/c_lpstk.v
DSP/hdl/PSQ/c_pcstk.v
DSP/hdl/PSQ/c_psq.v
DSP/hdl/PSQ/c_ststk.v
DSP/hdl/SPORT0/reg
DSP/hdl/SPORT0/s_autoctl.v
DSP/hdl/SPORT0/s_compand.v
DSP/hdl/SPORT0/s_compress.v
DSP/hdl/SPORT0/s_expand.v
DSP/hdl/SPORT0/s_rxctl0.v
DSP/hdl/SPORT0/s_scfg0.v
DSP/hdl/SPORT0/s_screg0.v
DSP/hdl/SPORT0/s_sport0.v
DSP/hdl/SPORT0/s_sport0_dummy.v
DSP/hdl/SPORT0/s_txctl0.v
DSP/hdl/SPORT1/s_rxctl1.v
DSP/hdl/SPORT1/s_scfg1.v
DSP/hdl/SPORT1/s_screg1.v
DSP/hdl/SPORT1/s_sport1.v
DSP/hdl/SPORT1/s_sport1_dummy.v
DSP/hdl/SPORT1/s_txctl1.v
DSP/hdl/TM/Timer.v
DSP/hdl/TM/Timer_dummy.v
DSP/hdl/TOP/def.par
DSP/hdl/TOP/t_clkctl.v
DSP/hdl/TOP/t_core.v
DSP/hdl/TOP/t_dsp.v
DSP/hdl/TOP/t_glogic.v
DSP/hdl/TOP/t_muxio.v
DSP/hdl/TOP/t_pin.013.v
DSP/hdl/TOP/t_pin.018.v
DSP/hdl/TOP/t_pin.035.v
DSP/hdl/TOP/t_pin_rtl.v
DSP/hdl/TOP/t_rego.v
DSP/hdl/TOP/t_top.v
DSP/include/x_def.v
DSP/syn/rpt/
DSP/syn/run/SW10200C.v
DSP/syn/run/SW10201A.v
DSP/syn/run/synDSP
DSP/syn/script/configure.v
DSP/syn/script/DSP.cons
DSP/syn/script/DSP.stc
DSP/syn/script/DSPgclk.cons
DSP/syn/script/ftc_name_rule.dcsh
DSP/syn/script/setup.scr
DSP/syn/script/syn_set.scr
DSP/syn/script/TOP_DOWN.scr
DSP/syn/script/TOP_DOWNread.scr
README
RISC/hdl/abc.v
RISC/hdl/abcd.v
RISC/hdl/abcde.v
RISC/hdl/abcdef.v
RISC/hdl/bcd.v
RISC/hdl/bcde.v
RISC/hdl/bcdef.v
RISC/hdl/bcdefg.v
RISC/hdl/cde.v
RISC/hdl/cdef.v
RISC/hdl/cdefg.v
RISC/hdl/cdefgh.v
RISC/hdl/def.v
RISC/hdl/defg.v
RISC/hdl/defgh.v
RISC/hdl/defghi.v
RISC/hdl/efg.v
RISC/hdl/efgh.v
RISC/hdl/efghi.v
RISC/hdl/efghij.v
RISC/hdl/fgh.v
RISC/hdl/fghi.v
RISC/hdl/fghij.v
RISC/hdl/fghijk.v
RISC/hdl/ghi.v
RISC/hdl/ghij.v
RISC/hdl/ghijk.v
RISC/hdl/ghijkl.v
RISC/hdl/hij.v
RISC/hdl/hijk.v
RISC/hdl/hijkl.v
RISC/hdl/hijklm.v
RISC/hdl/ijk.v
RISC/hdl/ijkl.v
RISC/hdl/ijklm.v
RISC/hdl/ijklmn.v
RISC/hdl/jkl.v
RISC/hdl/jklm.v
RISC/hdl/jklmn.v
RISC/hdl/jklmno.v
RISC/hdl/klmn.v
RISC/hdl/klmno.v
RISC/hdl/klmnop.v
RISC/hdl/list
RISC/hdl/lmno.v
RISC/hdl/lmnop.v
RISC/hdl/mno.v
RISC/hdl/mnop.v
RISC/hdl/mnopq.v
RISC/hdl/nop.v
RISC/hdl/nopq.v
RISC/hdl/nopqr.v
RISC/hdl/opq.v
RISC/hdl/opqr.v
RISC/hdl/opqrs.v
RISC/hdl/pqr.v
RISC/hdl/pqrs.v
RISC/hdl/pqrst.v
RISC/hdl/qrst.v
RISC/hdl/qrstu.v
RISC/hdl/rst.v
RISC/hdl/rstu.v
RISC/hdl/rstuv.v
RISC/hdl/stu.v
RISC/hdl/stuv.v
RISC/hdl/stuvw.v
RISC/hdl/tuv.v
RISC/hdl/tuvw.v
RISC/hdl/tuvwx.v
RISC/hdl/uvw.v
RISC/hdl/uvwx.v
RISC/hdl/uvwxy.v
RISC/hdl/vwx.v
RISC/hdl/vw

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