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文件名称:MULTIPLE_CORE

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    26.25kb
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硬件乘法器,其基础就是加法器结构,它已经是现代计算机中必不可少的一部分。[1]乘法器的模型就是基于“移位和相加”的算法。在该算法中,乘法器中每一个比特位都会产生一个局部乘积。第一个局部乘积由乘法器的LSB产生,第二个乘积由乘法器的第二位产生,以此类推。如果相应的乘数比特位是1,那么局部乘积就是被乘数的值,如果相应的乘数比特位是0,那么局部乘积全为0。每次局部乘积都向左移动一位。 -64-bit multiplier design experiment is the first in the HKUST and curriculum design, verilog program for proficiency in students in terms of Microelectronics is necessary for the design I have spent a long time.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

MUTIPLE_CORE/adder_64.mpf
MUTIPLE_CORE/main1_programme.v
MUTIPLE_CORE/test1_adder.v
MUTIPLE_CORE/主程序备份.txt
MUTIPLE_CORE/实验报告.doc
MUTIPLE_CORE/经验总结.txt
MUTIPLE_CORE

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