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文件名称:dds1

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [C/C++] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    1.5mb
  • 已下载：
    0次
  • 提 供 者：
    郭***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用ALTERA 公司的fpga芯片，编程语言是VerilogHDL,实现DDS数字信号发生器，可以产生正弦信号，三角信号，矩形信号。-ALTERA company fpga chip, programming languages, Verilog HDL, to achieve the DDS digital signal generator, can generate sine signal, triangle signal, rectangular signal
(系统自动生成,下载前可以参看下载内容)

下载文件列表

dds1/
dds1/a.mif
dds1/accu.v
dds1/C51_Ctrl.v
dds1/C51_Ctrl.v.bak
dds1/clk_divider.v
dds1/db/
dds1/db/altsyncram_1e71.tdf
dds1/db/altsyncram_6e91.tdf
dds1/db/altsyncram_6id1.tdf
dds1/db/altsyncram_8jb1.tdf
dds1/db/altsyncram_8qc2.tdf
dds1/db/altsyncram_dp61.tdf
dds1/db/altsyncram_ds61.tdf
dds1/db/altsyncram_ekb1.tdf
dds1/db/altsyncram_n571.tdf
dds1/db/altsyncram_nq61.tdf
dds1/db/altsyncram_oc71.tdf
dds1/db/altsyncram_oq61.tdf
dds1/db/altsyncram_tt61.tdf
dds1/db/altsyncram_uib1.tdf
dds1/db/dds1.(0).cnf.cdb
dds1/db/dds1.(0).cnf.hdb
dds1/db/dds1.(1).cnf.cdb
dds1/db/dds1.(1).cnf.hdb
dds1/db/dds1.(10).cnf.cdb
dds1/db/dds1.(10).cnf.hdb
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dds1/db/dds1.(11).cnf.hdb
dds1/db/dds1.(12).cnf.cdb
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dds1/db/dds1.(13).cnf.hdb
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dds1/db/dds1.(14).cnf.hdb
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dds1/db/dds1.(15).cnf.hdb
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dds1/db/dds1.(16).cnf.hdb
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dds1/db/dds1.(17).cnf.hdb
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dds1/db/dds1.(18).cnf.hdb
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dds1/db/dds1.(19).cnf.hdb
dds1/db/dds1.(2).cnf.cdb
dds1/db/dds1.(2).cnf.hdb
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dds1/db/dds1.(20).cnf.hdb
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dds1/db/dds1.(22).cnf.hdb
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dds1/db/dds1.(23).cnf.hdb
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dds1/db/dds1.(24).cnf.hdb
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dds1/db/dds1.(27).cnf.hdb
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dds1/db/dds1.(28).cnf.hdb
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dds1/db/dds1.(29).cnf.hdb
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dds1/db/dds1.asm_labs.ddb
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dds1/db/dds1.cmp.cdb
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dds1/db/dds1.cmp.hdb
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dds1/db/dds1.cmp.tdb
dds1/db/dds1.cmp0.ddb
dds1/db/dds1.db_info
dds1/db/dds1.eco.cdb
dds1/db/dds1.fit.qmsg
dds1/db/dds1.hier_info
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dds1/db/dds1.map.cdb
dds1/db/dds1.map.ecobp
dds1/db/dds1.map.hdb
dds1/db/dds1.map.logdb
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dds1/db/dds1.map_bb.cdb
dds1/db/dds1.map_bb.hdb
dds1/db/dds1.map_bb.hdbx
dds1/db/dds1.map_bb.logdb
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dds1/db/dds1.pre_map.hdb
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dds1/db/dds1.root_partition.cmp.dfp
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dds1/db/dds1.root_partition.cmp.rcf
dds1/db/dds1.root_partition.map.atm
dds1/db/dds1.root_partition.map.hdbx
dds1/db/dds1.root_partition.map.info
dds1/db/dds1.root_partition.merge_hb.atm
dds1/db/dds1.rtlv.hdb
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dds1/db/dds1.tis_db_list.ddb
dds1/db/dds1.tmw_info
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dds1/db/prev_cmp_dds1.qmsg
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dds1/dds.c
dds1/dds.LST
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dds1/dds.Opt
dds1/dds.plg
dds1/dds.Uv2
dds1/dds.v
dds1/dds.v.bak
dds1/dds1
dds1/dds1.asm.rpt
dds1/dds1.cdf
dds1/dds1.done
dds1/dds1.dpf
dds1/dds1.fit.rpt
dds1/dds1.fit.smsg
dds1/dds1.fit.summary
dds1/dds1.flow.rpt
dds1/dds1.hex
dds1/dds1.jdi
dds1/dds1.lnp
dds1/dds1.M51
dds1/dds1.map.rpt
dds1/dds1.map.smsg
dds1/dds1.map.summary
dds1/dds1.Opt
dds1/dds1.pin
dds1/dds1.plg
dds1/dds1.pof
dds1/dds1.qpf
dds1/dds1.qsf
dds1/dds1.qws
dds1/dds1.sim.rpt
dds1/dds1.sof
dds1/dds1.tan.rpt
dds1/dds1.tan.summary
dds1/dds1.Uv2
dds1/dds1_assignment_defaults.qdf
dds1/dds1_Opt.Bak
dds1/dds1_Uv2.Bak
dds1/dds_Opt.Bak
dds1/DDS_top.v
dds1/DDS_top.v.bak
dds1/DDS_top.vwf
dds1/dds_Uv2.Bak
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dds1/km.ppf
dds1/km.v
dds1/km_bb.v
dds1/km_wave0.jpg
dds1/km_waveforms.html
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dds1/matlab1/a_rom.mif
dds1/matlab1/sinn_rom.mif
dds1/matlab1/sin_rom.mif
dds1/matlab1/sin_rom.mif.bak
dds1/matlab1/squ_rom.mif
dds1/matlab1/trii_rom.mif
dds1/matlab1/tri_rom.mif
dds1/matlab1/t_rom.mif
dds1/Mif1.mif
dds1/Mif11.mif
dds1/mif2.mif
dds1/pll.ppf

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