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文件名称:SDRAM_control_design

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    2.47mb
  • 已下载：
    0次
  • 提 供 者：
    wang f******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一个SDRAM控制器的参考设计vhdl语言，包含了全部逻辑功能代码以及约束文件，包括一些综合布线后的文件和波形，有较高的参考价值。-A SDRAM controller reference design vhdl language contains all logic code as well as the constraints file, including files and waveform integrated wiring, there is a high reference value.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

SDRAM控制器设计/
SDRAM控制器设计/vhdl/
SDRAM控制器设计/vhdl/func_sim/
SDRAM控制器设计/vhdl/func_sim/brst_cntr.vhd
SDRAM控制器设计/vhdl/func_sim/cslt_cntr.vhd
SDRAM控制器设计/vhdl/func_sim/ki_cntr.vhd
SDRAM控制器设计/vhdl/func_sim/load.do
SDRAM控制器设计/vhdl/func_sim/mt48lc1m16a1.v
SDRAM控制器设计/vhdl/func_sim/mti_pkg.vhd
SDRAM控制器设计/vhdl/func_sim/rcd_cntr.vhd
SDRAM控制器设计/vhdl/func_sim/ref_cntr.vhd
SDRAM控制器设计/vhdl/func_sim/run_sim.do
SDRAM控制器设计/vhdl/func_sim/sdrm.vhd
SDRAM控制器设计/vhdl/func_sim/sdrmc_state.vhd
SDRAM控制器设计/vhdl/func_sim/sdrm_t.vhd
SDRAM控制器设计/vhdl/func_sim/state.do
SDRAM控制器设计/vhdl/func_sim/sys_int.vhd
SDRAM控制器设计/vhdl/func_sim/tb_sdrm.v
SDRAM控制器设计/vhdl/func_sim/transcript
SDRAM控制器设计/vhdl/func_sim/verwave.do
SDRAM控制器设计/vhdl/func_sim/work/
SDRAM控制器设计/vhdl/func_sim/work/brst_cntr/
SDRAM控制器设计/vhdl/func_sim/work/brst_cntr/brst_cntr_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/brst_cntr/brst_cntr_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/brst_cntr/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/cslt_cntr/
SDRAM控制器设计/vhdl/func_sim/work/cslt_cntr/cslt_cntr_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/cslt_cntr/cslt_cntr_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/cslt_cntr/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/ki_cntr/
SDRAM控制器设计/vhdl/func_sim/work/ki_cntr/ki_cntr_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/ki_cntr/ki_cntr_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/ki_cntr/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/mt48lc1m16a1/
SDRAM控制器设计/vhdl/func_sim/work/mt48lc1m16a1/verilog.asm
SDRAM控制器设计/vhdl/func_sim/work/mt48lc1m16a1/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/mt48lc1m16a1/_primary.vhd
SDRAM控制器设计/vhdl/func_sim/work/mti_pkg/
SDRAM控制器设计/vhdl/func_sim/work/mti_pkg/body.asm
SDRAM控制器设计/vhdl/func_sim/work/mti_pkg/body.dat
SDRAM控制器设计/vhdl/func_sim/work/mti_pkg/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/mti_pkg/_vhdl.asm
SDRAM控制器设计/vhdl/func_sim/work/rcd_cntr/
SDRAM控制器设计/vhdl/func_sim/work/rcd_cntr/rcd_cntr_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/rcd_cntr/rcd_cntr_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/rcd_cntr/_primary.dat
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SDRAM控制器设计/vhdl/func_sim/work/ref_cntr/_primary.dat
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SDRAM控制器设计/vhdl/func_sim/work/sdrmc_state/
SDRAM控制器设计/vhdl/func_sim/work/sdrmc_state/sdrmc_state_arch.asm
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SDRAM控制器设计/vhdl/func_sim/work/sdrm/sdrm_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/sdrm/sdrm_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/sdrm/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/sdrm_t/
SDRAM控制器设计/vhdl/func_sim/work/sdrm_t/sdrm_t_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/sdrm_t/sdrm_t_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/sdrm_t/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/sys_int/
SDRAM控制器设计/vhdl/func_sim/work/sys_int/sys_int_arch.asm
SDRAM控制器设计/vhdl/func_sim/work/sys_int/sys_int_arch.dat
SDRAM控制器设计/vhdl/func_sim/work/sys_int/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/testbench.asm
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/testbench.dat
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/verilog.asm
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/_primary.dat
SDRAM控制器设计/vhdl/func_sim/work/t_sdrm/_primary.vhd
SDRAM控制器设计/vhdl/func_sim/work/_info
SDRAM控制器设计/vhdl/micron/
SDRAM控制器设计/vhdl/micron/bank0.txt
SDRAM控制器设计/vhdl/micron/bank1.txt
SDRAM控制器设计/vhdl/micron/mt48lc1m16a1-8a.v
SDRAM控制器设计/vhdl/micron/mt48lc1m16a1.v
SDRAM控制器设计/vhdl/micron/test.v
SDRAM控制器设计/vhdl/par/
SDRAM控制器设计/vhdl/par/sdrm.bit
SDRAM控制器设计/vhdl/par/sdrm.edf
SDRAM控制器设计/vhdl/par/sdrm.ll
SDRAM控制器设计/vhdl/par/sdrm.ncf
SDRAM控制器设计/vhdl/par/xproj/
SDRAM控制器设计/vhdl/par/xproj/sdrm.xpj
SDRAM控制器设计/vhdl/par/xproj/ver1/
SDRAM控制器设计/vhdl/par/xproj/ver1/netlist.lst
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/bitgen.ut
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/command.his
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/fe.log
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/map.mrp
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/map.ncd
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/map.ngm
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/ngd2ver.log
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/ngd2vhdl.log
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/program.his
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/revision.obf
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/revision.rbf
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/rptbrwsr.dat
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.alf
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.bgn
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.bit
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.bld
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.dly
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.drc
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.ll
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.ncd
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.nga
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.ngd
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.pad
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.par
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.pcf
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.twr
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.ucf
SDRAM控制器设计/vhdl/par/xproj/ver1/rev1/sdrm.xpi
SDRAM控制器设计/vhdl

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