文件名称:as1
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- 上传时间：2013-04-23
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Verilong HDL是最frequenctly使用的硬件描述语言，因为它的简单和方便的属性之一。这当然AIMES设计一个数字时钟，配备4段显示，秒表和时间设定使用这种语言，甚至一些额外的功能，fundamatal。 DE1板设计时钟的实施贡献-Verilong HDL is one of the most frequenctly used hardware descr iption language because of its simple and convenient properties. This course aimes to design a digital clock equipped with the fundamatal functions of 4-segment display, stopwatch and time setting even some additional ones using this language . The implement of the designed clock is contributed by DE1 board
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