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文件名称:BCD

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2013-05-14
  • 文件大小：
    39.57kb
  • 已下载：
    0次
  • 提 供 者：
    姚***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

利用Verilog HDL语言实现BCD码的加法-Using Verilog HDL language implementation of BCD addition
(系统自动生成,下载前可以参看下载内容)

下载文件列表

BCD/
BCD/BCD.cr.mti
BCD/BCD.mpf
BCD/BCD.v
BCD/BCD.v.bak
BCD/BCD.xml
BCD/BCD_tb.v
BCD/BCD_tb.v.bak
BCD/transcript
BCD/vsim.wlf
BCD/work/
BCD/work/@_opt/
BCD/work/@_opt/_deps
BCD/work/@_opt/vopt1gy8kd
BCD/work/@_opt/vopt20xh8v
BCD/work/@_opt/vopt3gvtw8
BCD/work/@_opt/vopt40t3hn
BCD/work/@_opt/vopt5grc54
BCD/work/@_opt/vopt60qmsh
BCD/work/@_opt/vopt7gmydz
BCD/work/@_opt/vopt80k72d
BCD/work/@_opt/vopt9gignt
BCD/work/@_opt/vopta0hsa8
BCD/work/@_opt/voptbgf2zm
BCD/work/@b@c@d/
BCD/work/@b@c@d/_primary.dat
BCD/work/@b@c@d/_primary.dbs
BCD/work/@b@c@d/_primary.vhd
BCD/work/@b@c@d/verilog.asm
BCD/work/@b@c@d/verilog.rw
BCD/work/@b@c@d_tb/
BCD/work/@b@c@d_tb/_primary.dat
BCD/work/@b@c@d_tb/_primary.dbs
BCD/work/@b@c@d_tb/_primary.vhd
BCD/work/@b@c@d_tb/verilog.asm
BCD/work/@b@c@d_tb/verilog.rw
BCD/work/_info
BCD/work/_temp/
BCD/work/_temp/vlog058m6c
BCD/work/_temp/vlogk9i12n
BCD/work/_temp/vlogq2nxg9
BCD/work/_vmake

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