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文件名称:ml605_PCIe_Gen1_x8_rdf0008_13.4_c

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2013-07-23
  • 文件大小:
    3.9mb
  • 已下载:
    0次
  • 提 供 者:
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  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

该压缩文件为一个pcie接口设计源程序,源程序包含一个8通道gen1的pcie IP CORE和相应的用户接口程序,烧到开发板ml605中测试通过。 -The compressed file is a pcie interface design source code, source code contains an 8-channel gen1 of pcie IP CORE and the corresponding user interface program, burn development board ml605 in the test.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

ml605_pcie_x8_gen1/ml605_pcie_x8_gen1.cgc
ml605_pcie_x8_gen1/ml605_pcie_x8_gen1.cgp
ml605_pcie_x8_gen1/readme.txt
ml605_pcie_x8_gen1/ready_for_download/make_plat_mcs.bat
ml605_pcie_x8_gen1/ready_for_download/ml605_pcie_x8_gen1.cfi
ml605_pcie_x8_gen1/ready_for_download/ml605_pcie_x8_gen1.mcs
ml605_pcie_x8_gen1/ready_for_download/ml605_pcie_x8_gen1.prm
ml605_pcie_x8_gen1/ready_for_download/ml605_program_platflash.cmd
ml605_pcie_x8_gen1/v6_pcie_v1_7.gise
ml605_pcie_x8_gen1/v6_pcie_v1_7.veo
ml605_pcie_x8_gen1/v6_pcie_v1_7.xco
ml605_pcie_x8_gen1/v6_pcie_v1_7.xise
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/EP_MEM.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_64.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_64_RX_ENGINE.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_64_TX_ENGINE.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_EP.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_EP_MEM_ACCESS.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/PIO_TO_CTRL.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/pci_exp_8_lane_64b_ep.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/pcie_app_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/xilinx_pcie_2_0_ep_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/example_design/xilinx_pcie_2_0_ep_v6_08_lane_gen1_xc6vlx240t-ff1156-1_ML605.ucf
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/implement.bat
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/implement.log
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/implement.sh
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/results/mapped.mrp
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/results/routed.bit
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/results/routed.ncd
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/results/routed.pad
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/results/routed.par
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.cmd
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.log
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.ngc
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.ngc_xst.xrpt
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.ngr
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.prj
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xilinx_pcie_2_0_ep_v6.xcf
ml605_pcie_x8_gen1/v6_pcie_v1_7/implement/xst.srp
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/gtx_drp_chanalign_fix_3752_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/gtx_rx_valid_filter_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/gtx_tx_sync_rate_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/gtx_wrapper_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_2_0_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_bram_top_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_bram_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_brams_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_clocking_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_gtx_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_pipe_lane_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_pipe_misc_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_pipe_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_reset_delay_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/pcie_upconfig_fix_3451_v6.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/source/v6_pcie_v1_7.v
ml605_pcie_x8_gen1/v6_pcie_v1_7/v6_pcie_readme.txt
ml605_pcie_x8_gen1/v6_pcie_v1_7_flist.txt
ml605_pcie_x8_gen1/v6_pcie_v1_7_xmdf.tcl

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