文件名称:PipelineCPU
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- 上传时间：2013-11-01
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文件大小：11.55kb
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设计一个32位流水线MIPS微处理器，具体要求如下：
1. 至少运行下列MIPS32指令。
①算术运算指令：ADD、ADDU、SUB、SUBU、ADDI、ADDIU。
②逻辑运算指令：AND、OR、NOR、XOR、ANDI、ORI、XORI、SLT、SLTU、SLTI、SLTIU。
③移位指令：SLL、SLLV、SRL、SRLV、SRA。
④条件分支指令：BEQ、BNE、BGEZ、BGTZ、BLEZ、BLTZ。
⑤无条件跳转指令：J、JR。
⑥数据传送指令：LW、SW。
⑦空指令：NOP。
2. 采用5级流水线技术，对数据冒险实现转发或阻塞功能。
3. 在XUP Virtex-II Pro开发系统中实现MIPS微处理器，要求CPU的运行速度大于25MHz。-Design a 32-bit pipelined MIPS microprocessor, the specific requirements are as follows: 1. At least run the following MIPS32 instruction. ① arithmetic instructions: ADD, ADDU, SUB, SUBU, ADDI, ADDIU. ② logical operation instructions: AND, OR, NOR, XOR, ANDI, ORI, XORI, SLT, SLTU, SLTI, SLTIU. ③ shift instruction: SLL, SLLV, SRL, SRLV, SRA. ④ conditional branch instruction: BEQ, BNE, BGEZ, BGTZ, BLEZ, BLTZ. ⑤ unconditional jump instruction: J, JR. ⑥ data transfer instruction: LW, SW. ⑦ dummy: NOP. (2) using five pipeline technology, adventure on the forwarding or blocking of data functions. 3 In the XUP Virtex-II Pro development system to achieve MIPS microprocessors, requires the CPU to run faster than 25MHz.
1. 至少运行下列MIPS32指令。
①算术运算指令：ADD、ADDU、SUB、SUBU、ADDI、ADDIU。
②逻辑运算指令：AND、OR、NOR、XOR、ANDI、ORI、XORI、SLT、SLTU、SLTI、SLTIU。
③移位指令：SLL、SLLV、SRL、SRLV、SRA。
④条件分支指令：BEQ、BNE、BGEZ、BGTZ、BLEZ、BLTZ。
⑤无条件跳转指令：J、JR。
⑥数据传送指令：LW、SW。
⑦空指令：NOP。
2. 采用5级流水线技术，对数据冒险实现转发或阻塞功能。
3. 在XUP Virtex-II Pro开发系统中实现MIPS微处理器，要求CPU的运行速度大于25MHz。-Design a 32-bit pipelined MIPS microprocessor, the specific requirements are as follows: 1. At least run the following MIPS32 instruction. ① arithmetic instructions: ADD, ADDU, SUB, SUBU, ADDI, ADDIU. ② logical operation instructions: AND, OR, NOR, XOR, ANDI, ORI, XORI, SLT, SLTU, SLTI, SLTIU. ③ shift instruction: SLL, SLLV, SRL, SRLV, SRA. ④ conditional branch instruction: BEQ, BNE, BGEZ, BGTZ, BLEZ, BLTZ. ⑤ unconditional jump instruction: J, JR. ⑥ data transfer instruction: LW, SW. ⑦ dummy: NOP. (2) using five pipeline technology, adventure on the forwarding or blocking of data functions. 3 In the XUP Virtex-II Pro development system to achieve MIPS microprocessors, requires the CPU to run faster than 25MHz.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
ALU.v
DataRAM.v
Decode.v
EX.v
ID.v
IF.v
InstructionROM.v
MipsPipelineCPU.v
MultiRegisters.v
addr_forward_4.v
addr_sel_4.v
con_addr_32.v
ff_lib.v
mux_4.v
DataRAM.v
Decode.v
EX.v
ID.v
IF.v
InstructionROM.v
MipsPipelineCPU.v
MultiRegisters.v
addr_forward_4.v
addr_sel_4.v
con_addr_32.v
ff_lib.v
mux_4.v
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