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文件名称:uart_fifo

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2013-12-19
  • 文件大小：
    147kb
  • 已下载：
    0次
  • 提 供 者：
    X****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

带fifo的串口通信verilog设计，该设计为学习uart所用，完成PC端发送至fpga后fpga原数据返回，支持长字符串。-Serial communication with fifo verilog design, which is used to learn uart complete PC sends data back to the original post fpga fpga, support long strings.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

uart_fifo/clk_gen.v
uart_fifo/clk_gen.v.bak
uart_fifo/db/altsyncram_0124.tdf
uart_fifo/db/altsyncram_1124.tdf
uart_fifo/db/altsyncram_4u14.tdf
uart_fifo/db/altsyncram_8124.tdf
uart_fifo/db/altsyncram_g124.tdf
uart_fifo/db/altsyncram_q0k1.tdf
uart_fifo/db/altsyncram_u024.tdf
uart_fifo/db/a_dpfifo_ca31.tdf
uart_fifo/db/a_fefifo_18e.tdf
uart_fifo/db/cmpr_ngc.tdf
uart_fifo/db/cmpr_qgc.tdf
uart_fifo/db/cmpr_rgc.tdf
uart_fifo/db/cntr_23j.tdf
uart_fifo/db/cntr_3ob.tdf
uart_fifo/db/cntr_agi.tdf
uart_fifo/db/cntr_bbj.tdf
uart_fifo/db/cntr_bgi.tdf
uart_fifo/db/cntr_egi.tdf
uart_fifo/db/cntr_fo7.tdf
uart_fifo/db/cntr_i6j.tdf
uart_fifo/db/cntr_igi.tdf
uart_fifo/db/cntr_kgi.tdf
uart_fifo/db/cntr_o9j.tdf
uart_fifo/db/decode_dvf.tdf
uart_fifo/db/decode_jsa.tdf
uart_fifo/db/dpram_4711.tdf
uart_fifo/db/logic_util_heursitic.dat
uart_fifo/db/mux_1tc.tdf
uart_fifo/db/mux_dob.tdf
uart_fifo/db/mux_eob.tdf
uart_fifo/db/mux_hob.tdf
uart_fifo/db/mux_ssc.tdf
uart_fifo/db/mux_vsc.tdf
uart_fifo/db/prev_cmp_uart.qmsg
uart_fifo/db/scfifo_5431.tdf
uart_fifo/db/uart.db_info
uart_fifo/fifo_rw.v
uart_fifo/fifo_rw.v.bak
uart_fifo/greybox_tmp/cbx_args.txt
uart_fifo/incremental_db/compiled_partitions/uart.db_info
uart_fifo/incremental_db/README
uart_fifo/output_files/output_file.jic
uart_fifo/output_files/stp1.stp
uart_fifo/output_files/stp1_auto_stripped.stp
uart_fifo/output_files/uart.asm.rpt
uart_fifo/output_files/uart.cdf
uart_fifo/output_files/uart.done
uart_fifo/output_files/uart.fit.rpt
uart_fifo/output_files/uart.fit.smsg
uart_fifo/output_files/uart.fit.summary
uart_fifo/output_files/uart.flow.rpt
uart_fifo/output_files/uart.jdi
uart_fifo/output_files/uart.map.rpt
uart_fifo/output_files/uart.map.summary
uart_fifo/output_files/uart.pin
uart_fifo/output_files/uart.pof
uart_fifo/output_files/uart.sof
uart_fifo/output_files/uart.sta.rpt
uart_fifo/output_files/uart.sta.summary
uart_fifo/receive.v
uart_fifo/receive.v.bak
uart_fifo/send.v
uart_fifo/send.v.bak
uart_fifo/uart.qpf
uart_fifo/uart.qsf
uart_fifo/uart.qws
uart_fifo/uart.v
uart_fifo/uart.v.bak
uart_fifo/uart_assignment_defaults.qdf
uart_fifo/uar_fifo.qip
uart_fifo/uar_fifo.v
uart_fifo/uar_fifo_bb.v
uart_fifo/incremental_db/compiled_partitions
uart_fifo/db
uart_fifo/greybox_tmp
uart_fifo/incremental_db
uart_fifo/output_files
uart_fifo

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