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文件名称:digital_clock

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2017-04-17
  • 文件大小：
    3kb
  • 已下载：
    0次
  • 提 供 者：
    k****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于vivado的FPGA数字闹钟的程序，verilog语言编写-Vivado based on the FPGA digital alarm clock procedures, verilog language
(系统自动生成,下载前可以参看下载内容)

下载文件列表



digital_clock\design_source\bcd_counter.v
.............\.............\binbcd8.v
.............\.............\clk_1s.v
.............\.............\counter.v
.............\.............\count_top.v
.............\.............\display.v
.............\.............\seg7.v
.............\xdc\clock.xdc
.............\design_source
.............\xdc
digital_clock

相关说明

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