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文件名称:xst_vlog_bl2cl25

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2018-04-01
  • 文件大小：
    215kb
  • 已下载：
    0次
  • 提 供 者：
    happ*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

DDR 原厂IP核开源代码控制器vrilogHDL代码(xilinx ddr control xst)
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(系统自动生成,下载前可以参看下载内容)

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文件名大小更新时间
xst_vlog_bl2cl25 0 2018-03-30
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xst_vlog_bl2cl25\sim\readme.txt 1838 2007-06-22
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xst_vlog_bl2cl25\synth\mem_interface_top.lso 6 2007-06-22
xst_vlog_bl2cl25\synth\mem_interface_top.prj 1876 2007-06-22
xst_vlog_bl2cl25\synth\mem_interface_top.sdc 34 2007-06-22
xst_vlog_bl2cl25\synth\mem_interface_top.xcf 151 2007-06-22
xst_vlog_bl2cl25\synth\mem_interface_top_synp.sdc 2894 2007-06-22
xst_vlog_bl2cl25\synth\script_synp.tcl 3066 2007-06-22

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