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文件名称:fir_16

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [Matlab] [源码]
  • 上传时间：
    2012-10-18
  • 文件大小：
    725.42kb
  • 已下载：
    0次
  • 提 供 者：
    z****
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    无
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fir滤波器-verilog，基于verilog的fir滤波器源码-fir filter-verilog, the fir filter based on the Verilog source code
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