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文件名称:CY7C68013FPGA

  • 所属分类:
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  • 上传时间:
    2012-11-02
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    939kb
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USB控制芯片cy7c68013与FPGA通过slave fifo方式通信,块传输数据-USB controller chip and FPGA cy7c68013 way communication through the slave fifo, block data transfer
相关搜索: cy7c68013 USB fifo

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CY7C68013FPGA/BulkIn/bitgen.ut
CY7C68013FPGA/BulkIn/coregen.log
CY7C68013FPGA/BulkIn/coregen.prj
CY7C68013FPGA/BulkIn/FPGA.dhp
CY7C68013FPGA/BulkIn/ISE编程顺序.txt
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CY7C68013FPGA/BulkIn/top.mrp
CY7C68013FPGA/BulkIn/top.msd
CY7C68013FPGA/BulkIn/top.msk
CY7C68013FPGA/BulkIn/top.ngm
CY7C68013FPGA/BulkIn/top.pcf
CY7C68013FPGA/BulkIn/top.rbb
CY7C68013FPGA/BulkIn/top.rbd
CY7C68013FPGA/BulkIn/top.ut
CY7C68013FPGA/BulkIn/Top.vhdl
CY7C68013FPGA/BulkIn/top_clk分频.txt
CY7C68013FPGA/BulkIn/top_last_par.ncd
CY7C68013FPGA/BulkIn/ucf.ucf
CY7C68013FPGA/BulkIn/_impact.cmd
CY7C68013FPGA/BulkIn/_impact.log
CY7C68013FPGA/BulkIn/_ngo/netlist.lst
CY7C68013FPGA/BulkIn/__projnav.log
CY7C68013FPGA/BulkIn/FPGA_ise12migration.zip
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CY7C68013FPGA/BulkIn/_xmsgs/bitgen.xmsgs
CY7C68013FPGA/BulkIn/FPGA.gise
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CY7C68013FPGA/BulkIn/iseconfig/FPGA.projectmgr
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CY7C68013FPGA/BulkIn/top.prj
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CY7C68013FPGA/BulkIn/xst/work/sub00/vhpl01.vho
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CY7C68013FPGA/BulkIn/top_map.xrpt
CY7C68013FPGA/BulkIn/top.par
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CY7C68013FPGA/BulkIn/top_pad.txt
CY7C68013FPGA/BulkIn/top.unroutes
CY7C68013FPGA/BulkIn/top.ncd
CY7C68013FPGA/BulkIn/top.xpi
CY7C68013FPGA/BulkIn/top_par.xrpt
CY7C68013FPGA/BulkIn/top_guide.ncd
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CY7C68013FPGA/BulkIn/top.twr
CY7C68013FPGA/BulkIn/netgen/synthesis/top_synthesis.nlf
CY7C68013FPGA/BulkIn/netgen/synthesis/top_synthesis.v
CY7C68013FPGA/BulkIn/top_envsettings.html
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CY7C68013FPGA/BulkIn/top_summary.xml
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CY7C68013FPGA/BulkOut/prom.sig
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CY7C68013FPGA/BulkOut/top.rbb
CY7C68013FPGA/BulkOut/top.rbd
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CY7C68013FPGA/BulkOut/top_last_par.ncd
CY7C68013FPGA/BulkOut/ucf.ucf
CY7C68013FPGA/BulkOut/_impact.cmd
CY7C68013FPGA/BulkOut/_impact.log
CY7C68013FPGA/BulkOut/_ngo/netlist.lst
CY7C68013FPGA/BulkOut/__projnav.log
CY7C68013FPGA/BulkOut/FPGA_ise12migration.zip
CY7C68013FPGA/BulkOut/FPGA.xise
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