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文件名称:d_e_g_dds

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-06
  • 文件大小:
    1.2mb
  • 已下载:
    0次
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基于Verilog HDL的迟早门码元同步方案中的DDS程序,已经仿真通过,可以在FPGA开发板上实现。迟-早门方式实现码元同步在无线通信中有着广泛应用。来自华中科大。-Early-later gate of Verilog HDL-based symbol synchronization scheme in the DDS program, has been through simulation, can be achieved in the FPGA development board. From HUST.

相关搜索: 码元同步

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d_e_g_dds/
d_e_g_dds/cos_rom.mif
d_e_g_dds/cos_rom.v
d_e_g_dds/cos_rom_bb.v
d_e_g_dds/cos_rom_inst.v
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d_e_g_dds/db/altsyncram_qk31.tdf
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d_e_g_dds/db/DDS.(0).cnf.hdb
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d_e_g_dds/db/DDS.pss
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d_e_g_dds/db/DDS.sim.rdb
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d_e_g_dds/db/DDS.sld_design_entry_dsc.sci
d_e_g_dds/db/DDS.syn_hier_info
d_e_g_dds/db/DDS.tan.qmsg
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d_e_g_dds/db/decode_6pa.tdf
d_e_g_dds/db/mux_1lb.tdf
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d_e_g_dds/db/prev_cmp_DDS.qmsg
d_e_g_dds/db/prev_cmp_DDS.sim.qmsg
d_e_g_dds/db/wed.wsf
d_e_g_dds/DDS.asm.rpt
d_e_g_dds/DDS.done
d_e_g_dds/DDS.fit.rpt
d_e_g_dds/DDS.fit.smsg
d_e_g_dds/DDS.fit.summary
d_e_g_dds/DDS.flow.rpt
d_e_g_dds/DDS.map.rpt
d_e_g_dds/DDS.map.summary
d_e_g_dds/DDS.pin
d_e_g_dds/DDS.pof
d_e_g_dds/DDS.qpf
d_e_g_dds/DDS.qsf
d_e_g_dds/DDS.qws
d_e_g_dds/DDS.sim.rpt
d_e_g_dds/DDS.sof
d_e_g_dds/DDS.tan.rpt
d_e_g_dds/DDS.tan.summary
d_e_g_dds/DDS.v
d_e_g_dds/DDS.vwf

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