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搜索资源列表

  1. dds

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  2. 基于单片机与FPGA的DDS程序代码,产生任意波形-DDS-based MCU with FPGA-code, resulting in arbitrary waveform
  3. 所属分类:SCM

    • 发布日期:2017-04-05
    • 文件大小:345360
    • 提供者:jiangjun
  1. DDS

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  2. 本代码可以用于产生正余弦信号波形,利用FPGA内部的ROM放置一个正余弦采样点的数据表格,通过循环取址的方法,实现波形连续输出。-This code can be used to generate positive cosine signal waveforms, using FPGA' s internal ROM to place a sampling point is the cosine of the data tables, the circulation method of t
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:484558
    • 提供者:蔡野锋
  1. DDS

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  2. 同时用verilog 语言编写dds原代码用于生成正余弦波,并在FPGA平台进行验证-described dds direct digital frequency synthesis of the basic tenets addition to the use of verilog prepared dds source used to produce sine, and FPGA development platform for verification
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-25
    • 文件大小:1082
    • 提供者:scond
  1. 51-DDS

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  2. 不仅包含FPGA源码还包含51单片机控制源码,已经实现DDS功能,绝对原创。-Includes not only the FPGA source code also includes a 51 SCM control source, has been achieved DDS functions, absolutely original.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2184814
    • 提供者:张文琪
  1. dds

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  2. 基于FPGA的直接数字频率合成器(DDS)的设计-FPGA-based direct digital frequency synthesizer (DDS) design of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:828
    • 提供者:sunshine
  1. DDS

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  2. 这个一个基于FPGA的DDS原代码 可以生成正弦和余弦两种波形-This is a DDS code bepend on FPGA ,it can generate two waves.
  3. 所属分类:Other systems

    • 发布日期:2017-03-30
    • 文件大小:9628
    • 提供者:wuyanjun
  1. dds

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  2. dds信号发生器,硬件测试过,效果良好。文件包含整个fpga开发过程产生的所有文件-dds signal generator, the hardware tested to good effect. File contains the entire fpga development process of all documents generated
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:232057
    • 提供者:wdw
  1. DDSFPGA_cylone

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  2. DDS FPGA 模块,实用,欢迎大家下载-DDS FPGA programmer
  3. 所属分类:Other systems

    • 发布日期:2017-03-24
    • 文件大小:637940
    • 提供者:吴小平
  1. DDS

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  2. dds双通道波形发生器调制解调 fpga-dds sin cos phase
  3. 所属分类:Other systems

    • 发布日期:2017-04-04
    • 文件大小:580178
    • 提供者:春天
  1. prog_dds

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  2. FPGA VHDL DDS程序,采用FPGA实现1hz到100khz可调的dds程序,频率调节步长是变化的。-FPGA VHDL DDS program, using FPGA to achieve 1hz to 100khz adjustable dds procedures, the frequency adjustment step size is changing.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1240225
    • 提供者:张鹏
  1. tiaopin

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  2. 开题报告,基于Quartus ii的DDS设计和实现。-Opening report, based on Quartus ii of DDS design and implementation.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:146092
    • 提供者:fangming
  1. DDS

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  2. 基于fpga技术,采用DDS原理产生3MHZ的正弦波。 -Produced with the DDS sine wave 3MHZ.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:664
    • 提供者:王伟
  1. sin

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  2. sin正弦波的产生 DDS FPGA VHDL语言-sin sine wave generation DDS FPGA VHDL language
  3. 所属分类:assembly language

    • 发布日期:2017-04-09
    • 文件大小:1732025
    • 提供者:王盛力
  1. dds

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  2. 基于FPGA的DDS波形信号发生器,功能强大,代码规范,值得学习-FPGA-based DDS waveform signal generator, powerful, code specifications, it is worth learning
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:2561345
    • 提供者:Andy Lao
  1. wcy

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  2. FPGA-based direct digital synthesizer (DDS) design (source code)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:671016
    • 提供者:wangchuanyang
  1. dds

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  2. 本设计使用8051单片机ip核,并用VHDL语言设计DDS的各功能模块,利用顶层设计的思想组合成DDS(直接数字频率综合)函数信号发生器,并与单片机ip核的I/O口相连。编译完下载到可编程逻辑器件中(FPGA),实现相应的功能。该设计中使用的是LCD2004液晶显示。-dds
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:2347
    • 提供者:kelas
  1. dds

    0下载:
  2. MSP430控制FPGA实现DDS的程序!-FPGA realization of DDS MSP430 control procedures!
  3. 所属分类:SCM

    • 发布日期:2017-03-31
    • 文件大小:42024
    • 提供者:甘旭东
  1. DDS

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  2. 在FPGA中实现频率源的设计,使用硬件描述语言加以实现。-design DDS with verilog language
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:125947
    • 提供者:lin
  1. DDS

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  2. 本代码在fpga中实现了dds,程序有三个按键:一个控制产生的波形(正弦波或方波),另两个控制频率增加或降低。程序附有注释,并在signaltap中仿真成功。-The code is implemented in fpga a dds, program has three buttons: a control generated waveform (sine or square wave), the other two control the frequency increase or decr
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2167399
    • 提供者:郝强
  1. ddsVHDL

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  2. fpga设计dds实现调频 调相 调占空比 并用modelsim仿真成功-dds fpga vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6511487
    • 提供者:cc
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