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搜索资源列表

  1. DPLL

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  2. 数字锁相环DPLL实例程序,帮助理解PLL的结构和详细原理-DPLL DPLL examples of procedures to help understand the structure and PLL detailed Principle
  3. 所属分类:matlab例程

    • 发布日期:2008-10-13
    • 文件大小:986
    • 提供者:李向坤
  1. dpll_4

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  2. 实现4阶数字锁相环,老外写的,有详细注释,如果您觉得不错,就re一下-achieve four bands DPLL, a foreigner writing a detailed notes, if you think it's good, what re
  3. 所属分类:通讯编程

    • 发布日期:2008-10-13
    • 文件大小:1981
    • 提供者:liu
  1. 2005117163755

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  2. MPSK解调的关键在于载波同步和码元同步.这里采用 数字锁相环实现载波同步和码元同步。-MPSK demodulator is the key carrier synchronization and code synchronization. Here digital PLL carrier synchronization and code synchronization.
  3. 所属分类:界面编程

    • 发布日期:2008-10-13
    • 文件大小:614191
    • 提供者:牛亮
  1. verilogpll

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  2. 用verilog语言编写的全数字锁相环的源代码,基于fpga平台-using Verilog language prepared by the DPLL the source code, they simply based on the platform
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2008-10-13
    • 文件大小:3821
    • 提供者:letheo
  1. PLLpro

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  2. 关于数字锁相环的使用,结合FM,AM的使用来说明-DPLL on the use of combined FM and AM to illustrate the use of
  3. 所属分类:操作系统开发

    • 发布日期:2008-10-13
    • 文件大小:10670
    • 提供者:whuayan
  1. DDScom

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  2. 直接式数字锁相环频率合成器.用ELANIX公司SYSTEMVIEW运行.-direct digital PLL frequency synthesizer. SYSTEMVIEW ELANIX companies with operations.
  3. 所属分类:邮电通讯系统

    • 发布日期:2008-10-13
    • 文件大小:1714
    • 提供者:a
  1. pll_improvement

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  2. 一种改进的全数字锁相环设计 一种改进的全数字锁相环设计-an improved DPLL design an improved design DPLL
  3. 所属分类:通讯/手机编程

    • 发布日期:2008-10-13
    • 文件大小:102669
    • 提供者:李敏
  1. VHDLDPLL

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  2. 比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。-relatively good technical article, "based on VHDL DPLL the design" a key part of the source code.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:168107
    • 提供者:李湘鲁
  1. dpll0226

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  2. 用一片CPLD实现数字锁相环,用VHDL或V语言.-with a DPLL CPLD, VHDL or V language.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:184894
    • 提供者:sss
  1. DPLL0227+V+qt6

    0下载:
  2. 用一片CPLD实现数字锁相环,用VHDL或V语言.-with a DPLL CPLD, VHDL or V language.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:279141
    • 提供者:sss
  1. pll1218

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  2. 用一片CPLD实现数字锁相环,用VHDL或V语言.-with a DPLL CPLD, VHDL or V language.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:109264
    • 提供者:sss
  1. digital_loopback

    0下载:
  2. 基于ti公司6713dsp的数字锁相环,运行环境为ccs3.1。希望有所帮助。-ti-based company 6713dsp the DPLL, the operating environment for ccs3.1. Want some help.
  3. 所属分类:DSP编程

    • 发布日期:2008-10-13
    • 文件大小:85128
    • 提供者:水歌
  1. all_digital_phase_locked_loop

    1下载:
  2. 一篇关于数字锁相环的很好的文章,费了很大力气才搞到的-a DPLL on the good paper, and a great effort will involve the
  3. 所属分类:通讯编程

    • 发布日期:2008-10-13
    • 文件大小:249232
    • 提供者:刘小同
  1. code

    0下载:
  2. 数字锁相环的源代码。用硬件编程语言VHDL编写。
  3. 所属分类:中间件编程

    • 发布日期:2008-10-13
    • 文件大小:2380
    • 提供者:zaoyexu
  1. DigitalPLL

    1下载:
  2. 一篇简单易懂的关于数字锁相环概念原理设计的经典文章
  3. 所属分类:文件操作

    • 发布日期:2008-10-13
    • 文件大小:249213
    • 提供者:林晓叶
  1. 02

    0下载:
  2. 基于VHDL的全数字锁相环的设计 有关键部分的源代码 hehe !
  3. 所属分类:其它

    • 发布日期:2008-10-13
    • 文件大小:168592
    • 提供者:zhou wan
  1. pll

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  2. 实现同步时采用锁相环,锁相环实现的原理,及源代码,-Implementation of the principle of phase-locked loop, and the source code,
  3. 所属分类:Communication-Mobile

    • 发布日期:2017-04-24
    • 文件大小:111857
    • 提供者:qin
  1. 84f704a6df6c

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  2. 介绍数字锁相环的基本结构,详细分析基于FPGA的数字锁相环的鉴相器、环路滤波器、压控振荡器各部分的实现方法,并给出整个数字锁相环的实现原理图。仿真结果表明,分析合理,设计正确。-MC145159 PLL frequency synthesizer design and realization of PLL frequency synthesizer the basic principles of integrated PLL chip M C 145159 work characteristic
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:192323
    • 提供者:KID-hang
  1. dpll

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  2. 数字全锁相环的介绍文章,讲述了数字锁相环的实现原理和实现步骤(The introduction of the digital full phase locked loop is introduced, and the realization principle and the implementation steps of the digital phase locked loop are described)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2018-04-23
    • 文件大小:192512
    • 提供者:CrazyICer
  1. 基于DSP28335的单相PWM整流 双闭环PI控制

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  2. 利用DSPF28335实现单相桥式PWM整流器的双闭环PI控制,用到AD7606和数字锁相(Double-closed-loop PI control of single-phase bridge PWM rectifier using DSPF28335, using AD7606 and digital phase lock)
  3. 所属分类:DSP编程

    • 发布日期:2019-07-20
    • 文件大小:18432
    • 提供者:糊涂小兵
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