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gcd2
- GCD算法的FSM+D实现。即利用有限状态机和数据路径分开-GCD algorithm of the FSM + D realize it is using finite state machine and data path separate
bitfsm-0.7-beta
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migong
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Finite-state-machine
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Frame-synchronizer-
- 原创,帧同步器的Verilog代码,在FPGA上验证实现过,无误。作为通信系统帧传输的仿真,有限状态机同步态和失步态的切换仿真。-Original Verilog code for frame synchronization, verify the implementation on the FPGA, and correct. Frame transmission as the communication system simulation, finite state machine sync
FPGA_ps2_lcd
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Verilog-FSM
- VERILOG HDL 学习有限状态机的重要PPT-VERILOG HDL FSM PPT
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- 设计一个有限状态机,用以检测输入序列“1110010”-sequence check
STATE-CHECK
- 设计一个有限状态机,用以检测输入序列“1110010”-state check
selection-mechanism-driven
- 多线程并发服务器设计 有限状态机与有状态通信 基于消息驱动的异步选择机制 -Multi-threaded concurrent server design Finite state machine and a state of communication Based on the news of the selection mechanism driven asynchronous
C-programme-for-fsm
- 介绍了4种C的有限状态机写法,但愿能帮到你-introduce 4 kinds of fsm style in C language
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- 自动售货机控制系统VHDL有限状态机实现 利用VHDL可以避免繁琐的过程,直接利用状态转换图进行状态机的描述-Automatic vending machine control system VHDL finite state machine implementation To avoid the tedious process of VHDL, the direct use of the descr iption of the state transition diagram for
AD
- 有限状态机的设计——0809 A/D转换实验-VHDL for ADC0809
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- fpga使用有限状态机驱动tft lcd 彩屏,达到显示效果-The fpga use finite state machine driven tft lcd color screen, to display
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- 1935有限状态机 四个状态 一般有限状态机的设计-1935 finite state machine four state
CPUsheji
- 通过设计一个简化的计算机模型,培养利用有限状态机的概念设计复杂电路的思维,在设计过程中体会VHDL的RTL风格描述以及EDA工具Quartus的使用方法。同时了解CPU的控制原理与控制过程 通过动脑和动手解决数字逻辑设计中的实际问题,明确,巩固和灵活应用所学的理论知识,提高设计能力和实践操作技能。 -Through the design of a simplified computer models, to cultivate the concept of finite state ma
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- 有关有限状态机的设计实例,内附word文档说明-For finite state machine design examples, containing a word document instructions
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- VHDL实现有限状态机,实现平台XC3S500E-VHDL realization of the finite state machine, the platform XC3S500E