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  1. quartusII203quartusii

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  2. 讲解quartus的一些基本操作,如设计输入,综合,布局布线,下载-Quartus explain some basic operations such as design entry, synthesis, layout, downloads
  3. 所属分类:Other systems

    • 发布日期:2017-04-06
    • 文件大小:825.45kb
    • 提供者:郭淮
  1. TIA-EIA-568-B.1

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  2. 综合布线系统的标准,综合布线系统布线时参考- Generic Cabling System standard, reference by wiring cabling system
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:301.77kb
    • 提供者:邓昌建
  1. astro

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  2. Astro数字后端综合学习资料,资料非常详细,包括数字后端设置、布局、布线-Astro
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:927.87kb
    • 提供者:田皓
  1. Example-b3-1

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  2.  “\Example-b3-1\uart_regs\src”目录下为设计源文件  “\Example-b3-1\uart_regs\core”目录下为Altera的IP宏功能模块  “\Example-b3-1\uart_regs\sim\funcsim”目录下为功能仿真文件  “\Example-b3-1\uart_regs\sim\parsim”目录下为时序仿真文件 “\Example-b3-1\uart_regs\de
  3. 所属分类:Other systems

    • 发布日期:2017-05-07
    • 文件大小:1.44mb
    • 提供者:朱潮勇
  1. Example-s6-1

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  2. 1.完成一个Tcl的脚本,用来建立一个新工程 2.指定源文件,并执行分析和综合 3.执行I/O分配检查 4.使用Tcl更改I/O位置约束,重新作I/O检查 指定时序要求,对设计布局布线,并执行时序分析-1. Complete a Tcl scr ipt, used to create a new project 2. Specify the source file, and perform analysis and synthesis 3. Perform I/O ass
  3. 所属分类:Other systems

    • 发布日期:2017-04-28
    • 文件大小:54.83kb
    • 提供者:zhuchaoyong
  1. lab1 Vivado Design Flow

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  2. 适用于对verilog语言的初步学习,本文本就对RTL的编写,功能仿真,实现,布线,综合,以及生成比特流等环节进行了初步的描述。适合初学者学习。(For the preliminary study of Verilog language)
  3. 所属分类:其他

    • 发布日期:2017-12-31
    • 文件大小:1.39mb
    • 提供者:小樊
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