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aes_core
- AES高级加密算法的verilog语言实现。同时附有AES协议的pdf文档，和此代码的测试程序，可作为一个IP核直接使用，可减少开发人员的设计时间。-AES Advanced Encryption Algorithm Verilog language. While the agreement with AES pdf documents, and that this code of the test procedure can be used as an IP core direct use,
systemcaes.tar
- 面积最小的AES高级加密算法实现，和此代码的测试程序，可作为一个IP核直接使用，可减少开发人员的设计时间
sha1_v01.zip
- SHA-1加密算法的IP核，内涵文档，仿真测试文件,SHA-1 encryption algorithm of the IP core, the connotation of documents, simulation test file
8086IP
- 开源CPU软核8086的源码,波兰版Verilog源码-8086 soft-core CPU revenue source, the Polish version of Verilog source code
Linux_bc
- 对vga接口做了详细的介绍，并且有一 ·三段式Verilog的IDE程序，但只有DMA ·电子密码锁，基于fpga实现，密码正 ·IIR、FIR、FFT各模块程序设计例程， ·基于逻辑工具的以太网开发，基于逻 ·自己写的一个测温元件（ds18b20）的 ·光纤通信中的SDH数据帧解析及提取的 ·VHDL Programming by Example（McGr ·这是CAN总线控制器的IP核，源码是由 ·FPGA设计的SDRAM控制器，有仿真代码 ·xili
AES
- AES算法的verilog代码，即AES算法IP核-ip core for AES
tripledes
- 3-DES加密IP核VHDL源码，3次DES流水执行-VHDL source code for 3-DES encryption IP core, pipelined execution
364652261
- FIFO一个用IP核调用的控制程序，里面有调用的IP核和FIFO读写控制-FIFO with an IP core call control procedures, which are called IP core and FIFO read and write control
switch_to_led7
- 里面有IP核的应用，以及汇编语言的融合，将其组合在一起的程序-IP core inside the application, as well as the integration of assembly language, with its combination of the procedures
Linux_serial_network
- Linux为串口上网提供了丰富的支持，比如PPP（Peer-to-Peer Protocol, 端对端协议）和SLIP（Serial Line Interface Protocol, 非常老的串行线路接口协议），这里所说的"上网"是指把串口当成一个网络接口，通过封装网络数据包（如IP包）以达到无网卡的终端可以通过串口进行网络通 信。但是使用这两种协议必须得到内核的支持。例如，如果在没有配置PPP的Linux环境中使用PPP，除了安装PPP应用层软件外，还必须重新编译内 核。SLIP是一个比较老的
Md5Sopc
- 在Altera平台上实现Md5算法的IP核 modelsim进行MD5硬件代码的仿真和测试 quartusII 和nios软件实现ip核和驱动程序 已经测试程序的仿真和测试 代码调试通过 -Md5 algorithm simulation and test implementation in the Altera IP core platform modelsim the MD5 code simulation and test hardware and quartusII ip nios so
aes
- AES的IP核,AES的加密解密算法，包括密钥扩展程序-aes core verilog
MyIPCore_test
- 基于ZedBoard开发板的zynq7000系列芯片，通过PS调用PL的IP核的样例。该IP核可以控制ZedBoard开发板上的8个LED和5个开关。-ZedBoard based development board zynq7000 series chip, the sample of PS calling PL IP core. The IP core can control ZedBoard development board 8 LED and 5