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  1. dpll

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  2. DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低.

  3. 所属分类：RFID编程

    • 发布日期：2008-10-13
    • 文件大小：1386
    • 提供者：sharny

  1. digitalPLL

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  2. 数字锁相环实现源码，有很大的参考价值。 由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.

  3. 所属分类：RFID编程

    • 发布日期：2008-10-13
    • 文件大小：2482
    • 提供者：sharny

  1. DetectUSB

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  2. 自動侦察出usb插入或释放, 詳細資料顯示-auto detect USB insertion or release

  3. 所属分类：USB develop

    • 发布日期：2017-04-05
    • 文件大小：3171
    • 提供者：jan
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