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Crack_QII60_b178
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chap3
- adder4 hdl ok in Quartus II 5.1
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- altera Quartus II 減法器使用 配合LED，可自動與手動按鈕控製。 (含電路)
MIF_create
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Quartus+II+++ModelSim+SE+++后仿真+++库文件.rar
- Mentor公司的ModelSim是业界最优秀的HDL语言仿真软件，它能提供友好的仿真环境，是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术，编译仿真速度快，编译的代码与平台无关，便于保护IP核，个性化的图形界面和用户接口，为用户加快调错提供强有力的手段，是FPGA/ASIC设计的首选仿真软件。
Verilog数字系统设计教程(第2版)
- Verilog数字系统设计教程(第2版)”这本书的思考题没有答案，要多做实验和仿真-• Source code of designs in chapters 1 to 8. • Chapter 8 designs include the SAYEH processor, its C Compiler, and its Sort program run files. • Several Designs, including SAYEH, that are programmed o
cunchuqi
- maxplus环境下通过硬件实现存储器工作的原理展示-maxplus environment through the hardware implementation of the principle of working memory display
any_div_freq
- 可以对输入时钟任意分频(整数或小数),带Quartus II 完整项目文件.-Can be arbitrary points on the input clock frequency (integer or decimal), with complete Quartus II project document.
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- 一个简单形象的八位乘法器，VHDL语言汇编，在QUARTUS II 环境下运行-A simple image of eight multipliers, VHDL language compilation environment running under QUARTUS II
雷达时序控制
- verilog编程 雷达所有时序控制系统 基于Quartus II 实现 QPF整个工程
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- 伪随机序列与误码检测 工程文件 源代码 Quartus II仿真 结果截图-Pseudo-random sequence and error detection project file source code Quartus II simulation screenshot
VGA
- vga显示代码 Verilog语言 开发环境为quartus II，alteraFPGA-VGA display Verilog
FPGA实验指导书
- 很多程序实例，vhdl语言及quartus平台应用的实用实验资料(A lot of program examples, VHDL language and quartus platform application of practical experimental data)
license_quartus
- this is a licence file to crack quartus II version 15