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搜索资源列表

  1. Verilog

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  2. verilog HDL语言使用手册,包括:语法规则,RTL设计思想和方案等-verilog HDL language user manual, including: grammar rules, RTL design ideas and programs
  3. 所属分类:Document

    • 发布日期:2017-05-12
    • 文件大小:2939801
    • 提供者:徐杰猛
  1. verilog-coding-rules

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  2. Verilog HDL可综合RTL级代码设计规范及风格-Verilog HDL RTL level code design specifications and style
  3. 所属分类:File Formats

    • 发布日期:2015-07-28
    • 文件大小:172032
    • 提供者:
  1. april2010_1

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  2. 基于FPGA的方向滤波指纹图像增强算法实现,本文利用FPGA具有丰富寄存器资源、可满足高速系统设计等特点,设计了一种基于FPGA纯硬件方式实现方向滤波的指纹图像增强算法。设计采用寄存器传输级(RTL)硬件描述语言(Verilog HDL),利用时分复用和流水线处理等技术,完成了方向滤波指纹图像增强算法在FPGA上的实现。-Directional filtering fingerprint image enhancement algorithm based on FPGA using the FP
  3. 所属分类:Project Design

    • 发布日期:2017-05-01
    • 文件大小:928789
    • 提供者:kudding
  1. Principles-of-Verifiable-RTL-Design

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  2. 本书主要以HDL(verilog/vhdl)为例,详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧,涵概了测试的各个方面, 是目前进行IC设计的同仁们最为推荐的一本宝典-Book HDL (verilog/vhdl), a detailed account of the IC DESIGN FLOW, Verification and Test of design ideas, methods and techniques, and
  3. 所属分类:Project Design

    • 发布日期:2017-11-18
    • 文件大小:3880808
    • 提供者:杨明
  1. FFTPVerilog

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  2. FFT Verilog RTL 经过测试与Altera FFT IP相当-FFT Verilog RTL Altera FFT IP
  3. 所属分类:software engineering

    • 发布日期:2017-03-24
    • 文件大小:8036
    • 提供者:liu
  1. Principles-of-Verifiable-RTL-Design

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  2. 本书主要以HDL(verilog/vhdl)为例,详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧,涵概了测试的各个方面, 是目前进行IC设计的同仁们最为推荐的一本宝典-(Kluwer) Principles of Verifiable RTL Design (2nd Ed.)
  3. 所属分类:Project Design

    • 发布日期:2017-05-15
    • 文件大小:3908276
    • 提供者:周励
  1. vhd2vl

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  2. vhdl to verilog rtl converter, it support simple vhdl syntax, i think it is very useful
  3. 所属分类:software engineering

    • 发布日期:2017-03-25
    • 文件大小:39206
    • 提供者:xilei
  1. 华为verilog编程规范

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  2. 华为verilog编程规范,本规范规定了Proverilog编码规范,即采用verilog代码设计时的代码书写规范。本规范适用于逻辑芯片开发中使用verilog语言作为RTL级设计语言。
  3. 所属分类:咨询培训

  1. sample_tcam.tar

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  2. verilog RTL code for simple TCAM
  3. 所属分类:Project Design

    • 发布日期:2017-04-11
    • 文件大小:1043
    • 提供者:praveen
  1. 01287713

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  2. the project done in verilog for rtl
  3. 所属分类:Project Design

    • 发布日期:2017-04-26
    • 文件大小:264292
    • 提供者:darshan
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