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文件名称:dpll

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    427.36kb
  • 已下载：
    0次
  • 提 供 者：
    小***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

本工程为锁相环，采用全数字系统设计，输出频率在10M~100M之间！可改进。-This project is phase-locked loop, all-digital system design, the output frequency between the 10M ~ 100M! Can be improved.
相关搜索： DPLL DP

(系统自动生成,下载前可以参看下载内容)

下载文件列表

dpll/
dpll/db/
dpll/db/add_sub_1sh.tdf
dpll/db/add_sub_2sh.tdf
dpll/db/add_sub_5sh.tdf
dpll/db/add_sub_6sh.tdf
dpll/db/add_sub_lth.tdf
dpll/db/add_sub_mth.tdf
dpll/db/dpll.(0).cnf.cdb
dpll/db/dpll.(0).cnf.hdb
dpll/db/dpll.(1).cnf.cdb
dpll/db/dpll.(1).cnf.hdb
dpll/db/dpll.(2).cnf.cdb
dpll/db/dpll.(2).cnf.hdb
dpll/db/dpll.(3).cnf.cdb
dpll/db/dpll.(3).cnf.hdb
dpll/db/dpll.(4).cnf.cdb
dpll/db/dpll.(4).cnf.hdb
dpll/db/dpll.asm.qmsg
dpll/db/dpll.cbx.xml
dpll/db/dpll.cmp.bpm
dpll/db/dpll.cmp.cdb
dpll/db/dpll.cmp.ecobp
dpll/db/dpll.cmp.hdb
dpll/db/dpll.cmp.logdb
dpll/db/dpll.cmp.rdb
dpll/db/dpll.cmp.tdb
dpll/db/dpll.cmp0.ddb
dpll/db/dpll.cmp_bb.cdb
dpll/db/dpll.cmp_bb.hdb
dpll/db/dpll.cmp_bb.logdb
dpll/db/dpll.cmp_bb.rcf
dpll/db/dpll.dbp
dpll/db/dpll.db_info
dpll/db/dpll.eco.cdb
dpll/db/dpll.eds_overflow
dpll/db/dpll.fit.qmsg
dpll/db/dpll.fnsim.cdb
dpll/db/dpll.fnsim.hdb
dpll/db/dpll.fnsim.qmsg
dpll/db/dpll.hier_info
dpll/db/dpll.hif
dpll/db/dpll.map.bpm
dpll/db/dpll.map.cdb
dpll/db/dpll.map.ecobp
dpll/db/dpll.map.hdb
dpll/db/dpll.map.logdb
dpll/db/dpll.map.qmsg
dpll/db/dpll.map_bb.cdb
dpll/db/dpll.map_bb.hdb
dpll/db/dpll.map_bb.logdb
dpll/db/dpll.merge.qmsg
dpll/db/dpll.pre_map.cdb
dpll/db/dpll.pre_map.hdb
dpll/db/dpll.psp
dpll/db/dpll.pss
dpll/db/dpll.rtlv.hdb
dpll/db/dpll.rtlv_sg.cdb
dpll/db/dpll.rtlv_sg_swap.cdb
dpll/db/dpll.sgdiff.cdb
dpll/db/dpll.sgdiff.hdb
dpll/db/dpll.signalprobe.cdb
dpll/db/dpll.sim.hdb
dpll/db/dpll.sim.qmsg
dpll/db/dpll.sim.rdb
dpll/db/dpll.sim_ori.vwf
dpll/db/dpll.sld_design_entry.sci
dpll/db/dpll.sld_design_entry_dsc.sci
dpll/db/dpll.syn_hier_info
dpll/db/dpll.tan.qmsg
dpll/db/mux_5fc.tdf
dpll/db/mux_gdc.tdf
dpll/db/mux_ldc.tdf
dpll/db/wed.wsf
dpll/dec_inc.bdf
dpll/dec_inc.bsf
dpll/dff1.bsf
dpll/dff1.vhd
dpll/dpll.asm.rpt
dpll/dpll.bdf
dpll/dpll.done
dpll/dpll.fit.rpt
dpll/dpll.fit.smsg
dpll/dpll.fit.summary
dpll/dpll.flow.rpt
dpll/dpll.map.rpt
dpll/dpll.map.summary
dpll/dpll.merge.rpt
dpll/dpll.pin
dpll/dpll.pof
dpll/dpll.qpf
dpll/dpll.qsf
dpll/dpll.qws
dpll/dpll.sim.rpt
dpll/dpll.sof
dpll/dpll.tan.rpt
dpll/dpll.tan.summary
dpll/dpll.vwf
dpll/jkdff.bsf
dpll/jkdff.vhd
dpll/kenijishu.bsf
dpll/kenijishu.vhd
dpll/n_counter.bsf
dpll/n_counter.vhd
dpll/yihuo.bdf
dpll/yihuo.vhd

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