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  1. clock

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  2. 1、学习定时器T1溢出中断的使用 2、学习电脑时钟的编程方法 3、在程序运行时按SHIFT进行校时 使用注意: 1、应包含头文件slavr.h 2、在工程选项中的Additional Lib中填入slavr 使用编译器使用附加库文件-1, T1 timer overflow interrupt to learn the use of 2, to learn computer programming clock 3, the procedures for running t
  3. 所属分类:SCM

    • 发布日期:2017-04-08
    • 文件大小:1358
    • 提供者:BRADLEE
  1. shuzizhong

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  2. 1.计时功能采用24小时方式,显示小时、分钟、秒。 2.采用双键校时法,MODE和SET,前者选择始终模式(包括小时、分、秒校时),后者校时脉冲。 3.结果用6个共阳数码管显示。-1. Time functions the way the 24-hour, show hours, minutes, seconds. 2. The use of double bond at the Law School, MODE and SET, always choose the former mod
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:326033
    • 提供者:杨志厚
  1. CSntp_src

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  2. .Net 校时服务程序,可以指定校时服务器地址及其他参数-. Net service program at school, you can specify the server address when the school and other parameters
  3. 所属分类:Other windows programs

    • 发布日期:2017-04-04
    • 文件大小:17223
    • 提供者:Admrial
  1. clock

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  2. 多功能数字钟:在手动校时功能时,选择是调整小时,还是分 若长时间按住该键,还可使秒信号清零,用于精确调时 -Multi-function digital clock: In the manual, when the school functions, the option is to adjust hours, or minutes, if a long time hold the key, so that second signal can be cleared for accura
  3. 所属分类:assembly language

    • 发布日期:2017-04-07
    • 文件大小:1388
    • 提供者:
  1. gps

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  2. 与hollysys FM197 通讯 校时-Communication with the school when hollysys FM197
  3. 所属分类:Communication

    • 发布日期:2017-03-30
    • 文件大小:9844
    • 提供者:wgy
  1. clock

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  2. 这是一个数字时钟的数字逻辑电路,整个工程打包上传,时钟可以计时、校时、整点报时、定时闹钟。使用电路图实现的。在quatarsII里面仿真的并且下载到DE2板上运行过。-This is a digital clock digital logic circuits, the whole project package upload, the clock could be time, school hours, the whole point timekeeping, timing alarm clo
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2014-05-17
    • 文件大小:1041615
    • 提供者:ryan
  1. clockProgram

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  2. 这是一个汇编程序,是个简单的闹钟程序,可以获取系统时间、可以校时!-This is an assembler, is a simple alarm clock program, you can get the system time, to school, when!
  3. 所属分类:assembly language

    • 发布日期:2017-04-03
    • 文件大小:25003
    • 提供者:ryan
  1. shuzizhong

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  2. 这时用VHDL语言编写的多功能数字钟,具有正常的计时功能,还能进行校时、校分,并且具有整点报时功能-Then with the VHDL language multi-functional digital clock, with the normal timing functions, but also to the school, the school hours, and have the whole point timekeeping function of
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:451856
    • 提供者:小黄
  1. shuizhongvhdl

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  2. 这时一个数字钟的VHDL程序,有计时、校时、整点报时功能,很适合做EDA设计之用-When a digital clock in VHDL procedures, time, school hours, the whole point timekeeping function, it is suitable for use in EDA Design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1439
    • 提供者:小黄
  1. shuzizhong2008

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  2. 这时一个关于数字钟的VHDL程序,有计时、校时、报时等功能-When a digital clock on the VHDL program, there is time, school time, timer and other functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:81187
    • 提供者:吴凯
  1. clock

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  2. 实现一个能显示小时、分钟、秒的多功能时钟,具有整点报时、闹钟、手动校时功能。-To achieve a can display hours, minutes, seconds, multi-functional clock, with the whole point timekeeping, alarm clock, manual, when the school functions.
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-04
    • 文件大小:78068
    • 提供者:刘新
  1. DZZ1

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  2. 多功能数字钟 能进行正常的时、分、秒计时功能, 分别由6个数码管显示24小时、60分钟、60秒钟的计数器显示。   2. 能利用实验系统上的按键实现“校时”“校分”功能: 3. 能利用扬声器做整点报时-VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:1024085
    • 提供者:chenshilin
  1. 2

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  2. 利用maxplus2完成 1、 完成带时、分、秒显示的24h计时功能; 2、 能完成整点报时功能,要求当数字钟的分和秒计数器计到59min52s时,驱动音响电路,四高一低,最后一声高声结束,整点时间到; 3、 完成对“时”和“分”的校时,并能对秒计数器清零。 -Use maxplus2 completed one complete with hours, minutes, seconds, show 24h time functions 2, can complete the
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:168477
    • 提供者:小余同学
  1. clock

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  2. 基于vhdl的数字钟,分别由6个数码管显示24小时、60分钟、60秒的计数显示;设有校时、校分、秒清零校正功能,分别由3个按键控制;验证可用。-On vhdl digital clock, respectively, by 6 digital tube display 24 hours, 60 minutes, 60 seconds of the count display with school hours, school hours, seconds, cleared correction
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:267348
    • 提供者:ly
  1. main

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  2. 设计一电子钟,要求显示时、分、秒,时为24小时制 有晶体振荡器或555定时电路提供标准时间的基准信号 还要具有清零功能 扩展部分(具有校时功能,可以对小时和分单独校时,对分校时的时候,停止分向小时的进位,校时时钟源可以借用电路中的时钟 具有正点报时功能。-Design an electronic clock, require a showing hours, minutes, seconds, when a 24-hour system a crystal oscillator or timi
  3. 所属分类:assembly language

    • 发布日期:2017-04-03
    • 文件大小:727131
    • 提供者:张三
  1. shuzizhong

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  2. 1、24小时计数显示; 2、具有校时功能(时,分) ; 3、实现闹钟功能(定时,闹响); -1,24 hours counting display 2, with the school when the function (hour, minute) 3 to achieve alarm functions (timing, downtown ring)
  3. 所属分类:Other systems

    • 发布日期:2017-04-15
    • 文件大小:6843
    • 提供者:古月
  1. shuzizhongsheji

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  2. s1. 所设计数字钟具有“时”、“分”、“秒”的十进制数字显示(小时从00~23)。 2. 可以进行手动校时、校分功能。 3. 能进行整点报时。从59分51秒开始每隔2秒钟连续发出四次低音“嘟。嘟、嘟、嘟”,,最后一次发出高音“嗒”。此信号响起时即达整点。 -you can see see
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:160806
    • 提供者:江畔
  1. max2work

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  2. 数字钟 实现闹钟 定时校时 仿电台报时 利用verilog实现的 数电实验代码-alarm clock
  3. 所属分类:Other windows programs

    • 发布日期:2017-03-24
    • 文件大小:328634
    • 提供者:wiwi
  1. electric_clock

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  2. 基于stc89c52实现具有校时模式、定时模式,能够显示月、日、星期等功能的电子钟。-When the realization of the school-based stc89c52 mode, timing mode, can display month, day, week, and other functions of the electronic clock.
  3. 所属分类:SCM

    • 发布日期:2017-04-03
    • 文件大小:8615
    • 提供者:海阔天空
  1. Digital_System_Design_using_VHDL

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  2. 1.能正常计时。显示模式分为24小时制和12小时制。其中12小时制须显示上、下午。“时”、“分”、“秒”都要显示。 2.具有快速校准时、分、秒的功能。手动校准,用一个功能键选择校时、校分功能,用另一功能键调校对应时、分数值。 3.整点自动报时。在离整点10s时,便自动发出鸣叫声,步长1s,每隔1s鸣叫一次,前四响是低音,最后一响为高音,最后一响结束为整点。 -1. To resume normal time. Display mode is divided into 24-hour
  3. 所属分类:Project Design

    • 发布日期:2017-03-28
    • 文件大小:158420
    • 提供者:林文
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