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搜索资源列表

  1. 32Bitaludesign

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  2. Design of simple 32 bit alu for SPARTAN 3 paltform
  3. 所属分类:Other systems

    • 发布日期:2017-04-11
    • 文件大小:692
    • 提供者:Ammankumar
  1. ALU

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  2. Implementation of an ALU that supports sum/sub mul and div
  3. 所属分类:Mathimatics-Numerical algorithms

    • 发布日期:2017-04-04
    • 文件大小:267965
    • 提供者:Clay84
  1. ALU.vhd

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  2. Desarrollo de la Unidad Légica Aritmética (ALU) en VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:534
    • 提供者:ozkkr
  1. VHDLcodes

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  2. Behavioral descr iption of ALU, RAM MODULE, ROM MODULE, DIVIDE BY N COUNTER, GENERIC DIVIDER 2n+1, GCD CALCULATOR, GCD FSM CODE, JK FLIP FLOP in VHDL . These are fully synthesized codes with optimization.- Behavioral descr iption of ALU, RAM MODULE,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:6163
    • 提供者:Vijay
  1. ALU-ex1

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  2. 计算机中执行各种算术和逻辑运算操作的部件。运算器的基本操作包括加、减、乘、除四则运算,与、或、非、异或等逻辑操作,以及移位、比较和传送等操作,亦称算术逻辑部件(ALU)。计算机运行时,运算器的操作和操作种类由控制器决定。运算器处理的数据来自存储器;处理后的结果数据通常送回存储器,或暂时寄存在运算器中。 -alu code
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-03
    • 文件大小:175744
    • 提供者:wenjieli
  1. ALU

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  2. 算术逻辑部件的verilog代码,它能够实现半加器、全加器、比较、按位与、按位或、按位异或、加一、减一的操作-Arithmetic logic unit of the verilog code, it can achieve half adder, full adder, compare, bitwise and, bitwise or, bitwise xor, plus one, minus one operation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-28
    • 文件大小:169824
    • 提供者:李鹏飞
  1. Alu

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  2. 4位ALU逻辑运算器,用VHDL语言编写-4-bit ALU process using VHDL
  3. 所属分类:Other systems

    • 发布日期:2017-04-10
    • 文件大小:919
    • 提供者:mike
  1. alu

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  2. mcu,risc cpu Verilog源代码-mcu,risc cpu Verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:3963
    • 提供者:yzhang
  1. ALU

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  2. 实现加减乘除与或非和大小比较功能的ALU模块-Math and the non-realization of more functions and size of the module ALU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:681
    • 提供者:唐文博
  1. cpu

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  2. 设计以及基本的CPU,至少包括四个基本单元,控制单元,内部寄存器,ALU和指令集-The purpose of this project is to design a simple CPU (Central Processing Unit). This CPU has basic instruction set, and we will utilize its instruction set to generate a very simple program to verify its perf
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2196060
    • 提供者:mollyma
  1. alu

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  2. arithmetical-logic unit design in Verilog
  3. 所属分类:VHDL-FPGA-Verilog

  1. alu

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  2. ALU运算器实现基本算术运算+,-,*,/和逻辑运算-ALU with the basic math function and logic function
  3. 所属分类:Other systems

    • 发布日期:2017-04-05
    • 文件大小:1802
    • 提供者:hawa
  1. ALU

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  2. David pattern 的ALU模型编码-David pattern in the ALU model code
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:272974
    • 提供者:aguang
  1. 74181ALU

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  2. alu功能。实现计算机的数字运算。运用的是74181芯片-alu function. The number of computer-based operations. Use the 74181 chip. .
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-07
    • 文件大小:586
    • 提供者:刘墉
  1. ALU

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  2. 一个全的alu, 可以学些东西,对初学者有用-alu, can learn some things, useful for beginners
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:353842
    • 提供者:高翔
  1. Designs

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  2. design files in verilog, alu, array mult, carry shift etc.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:37891
    • 提供者:p2p_123
  1. alu

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  2. 实现16-bits alu功能,其中包含按位逻辑运算,加减等运算。
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:19808
    • 提供者:张卫华
  1. ALU

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  2. VHDL code for 3 bit ALU
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:10092
    • 提供者:vasu
  1. alu

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  2. 实现五位加法器功能,还有ALU的程序模块!同时有四位全加器的功能模块!-Adder to achieve five functions, as well as program modules ALU! At the same time there are four full-adder modules!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:577
    • 提供者:qixia
  1. alu

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  2. 运算器实现,运用Veriolog语言,编程实现,无错误,顺利编译,可执行,仿真图正确~-ALU implementation, the use of Veriolog language, programming, error-free, smooth build, executable, simulation plan correctly ~
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:219932
    • 提供者:uyuy0401
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