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搜索资源列表

  1. ddsmodem

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  2. modem ask, fsk, psk program susing DDS
  3. 所属分类:Modem program

    • 发布日期:2017-03-28
    • 文件大小:12740
    • 提供者:venkata
  1. Study_on_Key_Technologies_of_n4-DQPSK_Modulation_a

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  2. 本文首先研究可4一DQPsK调制解调系统中调制部分的基本原理和各个模块的设计方案,重点研究成形滤波器和直接数字频率合成器 (DireetoigitalFrequeneySynihesis,简称DDS),并针对各个关键模块算法进行matlab设计仿真,展示仿真结果。其次,研究调制解调系统解调部分的基本原理和各个模块的设计方案,重点研究差分解调,数字下变频和位同步算法,也针对其各个关键模块进行算法的Matlab设计仿真。然后用Matlab对整个系统进行理论仿真,得出结论。在此基础 上,采用超高速
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-19
    • 文件大小:5458230
    • 提供者:cai
  1. dds-sin-generator

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  2. 正铉波发生器 dds 一共有8个vhdl文件组成。其中dds为头文件-dds
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:6704
    • 提供者:李磊
  1. frequency_generator

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  2. DDS in our camera design
  3. 所属分类:Other systems

    • 发布日期:2017-04-08
    • 文件大小:5822
    • 提供者:Alexander
  1. DDS1-2

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  2. 利用FPGA设计一个直接数字频率合成器(DDS),要求能够通过键盘设定输出正弦波、三角波和方波,输出波形频率由键盘输入设定,液晶显示屏显示输出波形类型和频率,输出频率范围10Hz-20kHz,步长0.5Hz。-FPGA design using a direct digital synthesizer (DDS), requires the ability to set the keyboard output sine wave, triangle wave and square wave ou
  3. 所属分类:source in ebook

    • 发布日期:2017-04-09
    • 文件大小:1855933
    • 提供者:张箭箭
  1. DDS

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  2. vhdl编写的dds信号发生器 这是比较古老的写法,但很简单-vhdl prepared dds signal generator which is a more ancient writing, but it is simple
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:230544
    • 提供者:deyi
  1. ad9958

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  2. AD9958是一款功能强大的DDS芯片,是AD公司新上市的产品,能够产生标准信号已及线性调频,非线性调频等信号。-AD9958 is a new chip with much more greater function.It is very suitable in signal processing. It can generate kinds of signal format such as standord signal and lfm signal.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-13
    • 文件大小:3392160
    • 提供者:xujingwei
  1. FPGA_DDS

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  2. 基于FPGA的DDS信号发生器产生VHDL源码及其测试激励文件的matlab模型,在modelsim下仿真通过-FPGA-based VHDL source DDS signal generator and the test stimulus file matlab model simulation in modelsim adopted under
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-06-02
    • 文件大小:14486481
    • 提供者:乐毅学
  1. ep1c6_29_dds

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  2. 此程序为一实现DDS的程序,很好的用VHDL语言编写。-this is a dds program by VHDL .Tt is a very accutate program.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:107053
    • 提供者:name
  1. sin

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  2. sin正弦波的产生 DDS FPGA VHDL语言-sin sine wave generation DDS FPGA VHDL language
  3. 所属分类:assembly language

    • 发布日期:2017-04-09
    • 文件大小:1732025
    • 提供者:王盛力
  1. DDS

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  2. 基于FPGA的DDS的相位累加器详细介绍,是VHDL编程,利用quartus2平台.-Design of Direct digital synthesis Signal Generator
  3. 所属分类:Other systems

    • 发布日期:2017-04-02
    • 文件大小:381304
    • 提供者:高慧
  1. DDS_Set

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  2. AD9852,DDS芯片接收数据逻辑。(Verilog语言)-AD9852, DDS chips receive data logic. (Verilog language)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:1440
    • 提供者:zhangwei
  1. xxtpxh

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  2. 线性调频信号运用dds中改变k来实现信号调频的策略-Linear FM signal to change the use of k dds FM' s strategy to achieve signal
  3. 所属分类:Communication

    • 发布日期:2017-04-02
    • 文件大小:309092
    • 提供者:张蓓蕾
  1. dds_last

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  2. 用VHDL编写的DDS,实用简洁,利于学习交流-Prepared using VHDL DDS, practical simplicity, conducive to learning exchange
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-02
    • 文件大小:657198
    • 提供者:zhuhaotian
  1. dds

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  2. vhdl编写,利用fpga完成了dds发生器的功能-vhdl prepared using fpga complete function generator dds
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:268806
    • 提供者:xxhlshe
  1. ddsVHDL

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  2. fpga设计dds实现调频 调相 调占空比 并用modelsim仿真成功-dds fpga vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:6511487
    • 提供者:cc
  1. dds

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  2. 基于VHDL语言,主要用于实现正弦波发生器-Based on VHDL language, mainly for the realization of sine wave generator
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1908
    • 提供者:碗豆
  1. ddsfinal1

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  2. verilog语言实现的dds代码,并行通信,生成四种波形,大赛编写的代码,modelsim仿真-verilog language dds code,modelsim debug
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1138036
    • 提供者:杨天
  1. DDS

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  2. dds的fpga实现,用的是VHDL语言,希望能帮到大家-dds of fpga implementation, using a VHDL language, we hope to help
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5889
    • 提供者:赖月经
  1. eda

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  2. 南京理工大学EDA实验多功能数字钟+闹钟+dds+am调幅。-Nanjing University of EDA test multifunction digital clock+ alarm+ dds+ am AM.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-24
    • 文件大小:8145804
    • 提供者:吴逸汀
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