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搜索资源列表

  1. nandH_10

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  2. 该设计实现十路而输入与非门产生环路自激振荡-Here is a disign which can make ten nand2 standand logic gate shock by itself
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:31007
    • 提供者:huguoli
  1. kruskal

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  2. K r u s k a l算法每次选择n- 1条边,所使用的贪婪准则是:从剩下的边中选择一条不会产生环路的具有最小耗费的边加入已选择的边的集合中。注意到所选取的边若产生环路则不可能形成一棵生成树-K ruskal algorithm each time you select n-1 edges, using criteria of greed: from the left side, select a loop with no minimum spend has been selected to
  3. 所属分类:Data structs

    • 发布日期:2017-04-11
    • 文件大小:644
    • 提供者:黄京
  1. SINSGPS-ouhe

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  2. SINSGPS紧耦合接收机载波跟踪环路分析,属于北斗导航年会的一篇文章-SINSGPS tightly-coupled receiver carrier tracking loop analysis, is the annual meeting of the Beidou navigation article
  3. 所属分类:GPS develop

    • 发布日期:2017-04-04
    • 文件大小:88518
    • 提供者:
  1. Rapid-Acquisition-of-Doppler-Shift-

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  2. 本文提出了一种适用于低轨卫异扩频通信系统的多普勒频移快捕方法.该方法基于数字匹配滤波器及自动频率控制环路_利用数字匹配滤波器的囚码快捕特性及其输出主相关峰值对频偏的敏感性,缩短多普勒频移的 捕获时间.论文首先推导了多普勒频移的平均捕获时间表达式,然后根据数值分析结果得到了准最佳捕获判决策略,最后通过比较验证了该快捕方法相对于传统串行捕获方法在性能上的提高. -This paper presents a low-orbit health for different spread spect
  3. 所属分类:matlab

    • 发布日期:2017-03-27
    • 文件大小:815566
    • 提供者:李嵩
  1. digital-FM-radio-design-

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  2. 本设计是一个数字调频收音机,调频就是频率调制,所谓频率调制就是原来等幅恒频的高频信号的频率,随着调制信号(音频信号)的幅度变化而变化,调频收音机(FM Radio)就是接收这些频率调制的无线电信号,经过解调还原成原信号的电子设备。FM Radio电路一般主要由接收天线、振荡器、混频器、AGC(自动增益控制)、中频放大器、中频限幅器、中频滤波器、鉴频器、低频静噪电路、搜索调谐电路、信号检测电路及频率锁定环路、音频输出电路等组成。本设计就是用单片机控制集成了上述所有FM功能的专用芯片,设计一个数字
  3. 所属分类:SCM

    • 发布日期:2017-03-23
    • 文件大小:441386
    • 提供者:周涛
  1. Hamilton

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  2. 哈密顿环路算法 解压后可看matlab实现哦-Hamilton can look after decompression loop algorithm
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-01
    • 文件大小:35938
    • 提供者:李明
  1. CDR_NTF

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  2. 从数字电路角度,分析PI(比例和积分)环路滤波电路所组成的闭环控制环路的传输函数以及误差传输函数的形状,从中可以看书环路的peaking,3db带宽以及稳定性等性能-From the perspective of digital circuits, analyze the PI(propotional & integral) loop filter s closed-loop transfer function as well as the error transfer function, fr
  3. 所属分类:matlab

    • 发布日期:2017-04-06
    • 文件大小:697
    • 提供者:
  1. Uniform-loop-based-on--LDPC

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  2. 一种基于均匀环路的LDPC码校验矩阵的构造方法,发表在信号处理杂志上。-Uniform loop based on check matrix of LDPC code construction method
  3. 所属分类:Communication

    • 发布日期:2017-04-03
    • 文件大小:376027
    • 提供者:tt
  1. WinADSL

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  2. WINADSL例子 ADSL (Asymmetric Digital Subscriber Line ,非对称数字用户环路)是一种新的数据传输方式。它因为上行和下行带宽不对称,因此称为非对称数字用户线环路。它采用频分复用技术把普通的电话线分成了电话、上行和下行三个相对独立的信道,从而避免了相互之间的干扰。即使边打电话边上网,也不会发生上网速率和通话质量下降的情况。通常ADSL在不影响正常电话通信的情况下可以提供最高3.5Mbps的上行速度和最高24Mbps的下行速度。-ADSL (As
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-04
    • 文件大小:27996
    • 提供者:ice
  1. gps_software

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  2. 文档描述了GPS软件接收机从射频前端到后端数据处理的详细设计,包括环路参数的计算及仿真。非常实用-failed to translate
  3. 所属分类:GPS develop

    • 发布日期:2017-05-04
    • 文件大小:1133502
    • 提供者:刘新宇
  1. SATLSim

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  2. 卡尔加里大学写的跟踪环路程序,用来进行算法验证和测试。-tracking loop for test by Calgary University
  3. 所属分类:matlab

    • 发布日期:2017-03-31
    • 文件大小:62753
    • 提供者:刘杨
  1. Cisco-show-interface-order-analysis

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  2. Cisco Show interface 命令详解,适用于思科路由器的配置与调试,包括接口封装命令,环路设置命令,ARP协议。-Cisco Show interface command explain, apply to the Cisco router configuration and commissioning, including the interface encapsulation command, loop set command, ARP protocol.
  3. 所属分类:Project Manage

    • 发布日期:2017-03-28
    • 文件大小:258894
    • 提供者:清理
  1. good

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  2. 信号发生器,产生可调pwm信号,和可控的四路环路信号-singal merch
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:315611
    • 提供者:王桢
  1. Hamiltonian-loop

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  2. Hamiltonian loop 哈密顿环路解决图论最短路问题 -Hamiltonian loop
  3. 所属分类:matlab

    • 发布日期:2017-04-01
    • 文件大小:575
    • 提供者:赵君威
  1. Costas-matlab

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  2. 针对扩频系统的载波同步, 研究了数字Costas 环的设计和实现方法。介绍了数字Costas 环的结构、实现 载波同步的基本方法。以二阶环为例, 分析了数字锁相环的环路滤波器的参数设计方法, 为数字Costas 环的设计提 供了参考。提出了在高速信号处理板( 以FPGA 和DSP 为基础) 中数字Costas 环的实现方案, 经工程验证, 能够实现 载波同步, 解调出所需信号。-Design and Implementation of Digital Costas-loop
  3. 所属分类:software engineering

    • 发布日期:2017-03-26
    • 文件大小:204924
    • 提供者:ningxiaomeng
  1. IIR

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  2. 环路滤波器的FPGA实现,使用VERILOG语言,ISE13.2编译环境-The loop filter FPGA realizing, use VERILOG language, ISE13.2 compile environment
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:792
    • 提供者:法克尤
  1. PLL_1

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  2. 为锁相回路或锁相环,用来统一整合时脉讯号,使内存能正确的存取资料。PLL用于振荡器中的反馈技术。 许多电子设备要正常工作,通常需要外部的输入信号与内部的振荡信号同步,利 用锁相环路就可以实现这个目的。-For phase lock loop or phase lock loop, the unification and the integration of the pulse signal used to when, make memory can correct access material
  3. 所属分类:Other systems

    • 发布日期:2017-04-08
    • 文件大小:3415
    • 提供者:123
  1. delayofdm

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  2. ofdm 环路延迟估计,包括整数倍估计和小数倍估计。估计误差可调。-The ofdm loop delay estimation, including an integer multiple of estimates and a small multiple of the estimated. The estimation error is adjustable.
  3. 所属分类:3G develop

    • 发布日期:2017-04-13
    • 文件大小:2149
    • 提供者:
  1. The-banker

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  2. 银行家算法我知道了它是避免死锁的一种重要方法,本实验要求用高级语言编写和调试一个简单的银行家算法程序。通过这个实验我体会和了解死锁和避免死锁的具体实施方法更加深了解有关资源申请、避免死锁等概念。死锁的产生,必须同时满足四个条件,互斥条件,请求和保持条件,不剥夺条件,环路等待条件只要破坏上述四个条件中除去互斥资源的条件外系统就不会发生死锁。通过这个算法可用解决生活中的实际问题。-The banker' s algorithm, I know it is an important method
  3. 所属分类:OS Develop

    • 发布日期:2017-03-31
    • 文件大小:27926
    • 提供者:k
  1. main_bitloop

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  2. 位同步程序,本程序通过早迟门的结果,通过相位误差鉴别器和环路滤波器和DCO,来达到位同步。-Bit synchronization program, this program, the results of the early-late gate phase error discriminator and loop filter and DCO to achieve bit synchronization.
  3. 所属分类:matlab

    • 发布日期:2017-04-01
    • 文件大小:2045
    • 提供者:jackjiang
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