文件名称:Usegg7_11s
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- 上传时间：2012-11-16
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用VHDL描述一个让6个数码管同时显示出来的控制器，同时显示出来0、1、2、3、4、5这6个不不同的数字图形到6个数码管上，输入时钟调节频率，使的能够观察到稳定显示出来的6个数字。可异步复位
-With VHDL descr iption of a let six digital tube display controller, 0,1,2,3,4,5 six different digital graphics displayed to six digital tube, adjust the frequency of the input clock able to observe so stable display six digits. Can be asynchronous reset
-With VHDL descr iption of a let six digital tube display controller, 0,1,2,3,4,5 six different digital graphics displayed to six digital tube, adjust the frequency of the input clock able to observe so stable display six digits. Can be asynchronous reset
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