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文件名称:powerlink

  • 所属分类：
    Other systems
  • 标签属性：
    [PDF]
  • 上传时间：
    2014-04-28
  • 文件大小：
    2.8mb
  • 已下载：
    0次
  • 提 供 者：
    Robbi******
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

powerlink 次站VHDL源码，可以实现4中不同的模式，基于xilinx平台。-powerlink slave VHDL sourcecode，which is based on Xilinx platform.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

powerlink/pcores/axi_powerlink_v0_28_a/data/axi_powerlink_v2_1_0.mdd
powerlink/pcores/axi_powerlink_v0_28_a/data/axi_powerlink_v2_1_0.mpd
powerlink/pcores/axi_powerlink_v0_28_a/data/axi_powerlink_v2_1_0.mui
powerlink/pcores/axi_powerlink_v0_28_a/data/axi_powerlink_v2_1_0.pao
powerlink/pcores/axi_powerlink_v0_28_a/data/axi_powerlink_v2_1_0.tcl
powerlink/pcores/axi_powerlink_v0_28_a/doc/01_POWERLINK-IP-Core_Xilinx.pdf
powerlink/pcores/axi_powerlink_v0_28_a/doc/02_POWERLINK-IP-Core_Generic.pdf
powerlink/pcores/axi_powerlink_v0_28_a/doc/03_OpenMAC.pdf
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/axi_powerlink.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/addr_decoder.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/edgedet.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/memMap.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/req_ack.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/slow2fastSync.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/lib/sync.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openFILTER.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openHUB.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_16to32conv.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_cmp.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx/async_fifo_ctrl.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx/fifo_read.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx/fifo_write.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx/n_synchronizer.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAmaster/dma_handler.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAmaster/ipif_master_handler.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAmaster/master_handler.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAmaster.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DPR_Altera_qsys.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_DPR_Xilinx.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_Ethernet.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_phyAct.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_PHYMI.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/openMAC_rmii2mii.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_apIrqGen.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_controlStatusReg.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_dpr_Xilinx.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_event.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_led.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_par.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_simpleReg.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_spi.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/pdi_tripleVBufLogic.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/portio.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/portio_cnt.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/powerlink.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/spi.vhd
powerlink/pcores/axi_powerlink_v0_28_a/hdl/vhdl/spi_sreg.vhd
powerlink/pcores/axi_powerlink_v0_28_a/revision.txt
powerlink/pcores/plb_powerlink_v0_28_a/data/plb_powerlink_v2_1_0.mdd
powerlink/pcores/plb_powerlink_v0_28_a/data/plb_powerlink_v2_1_0.mpd
powerlink/pcores/plb_powerlink_v0_28_a/data/plb_powerlink_v2_1_0.mui
powerlink/pcores/plb_powerlink_v0_28_a/data/plb_powerlink_v2_1_0.pao
powerlink/pcores/plb_powerlink_v0_28_a/data/plb_powerlink_v2_1_0.tcl
powerlink/pcores/plb_powerlink_v0_28_a/doc/01_POWERLINK-IP-Core_Xilinx.pdf
powerlink/pcores/plb_powerlink_v0_28_a/doc/02_POWERLINK-IP-Core_Generic.pdf
powerlink/pcores/plb_powerlink_v0_28_a/doc/03_OpenMAC.pdf
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powerlink/pcores/plb_powerlink_v0_28_a/hdl/vhdl/openMAC_DMAFifo_Xilinx/fifo_write.vhd
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powerlink/

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