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文件名称:PCIE

  • 所属分类：
    Other systems
  • 标签属性：
    [PDF]
  • 上传时间：
    2015-09-02
  • 文件大小：
    5.89mb
  • 已下载：
    0次
  • 提 供 者：
    xiao****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

xilinx spartan6的pcie pio源代码-xilinx spartan6 pcie pio demo
(系统自动生成,下载前可以参看下载内容)

下载文件列表

PCIE/.Xil-PlanAhead-7968-tjy_pc/ngc2edif/xilinx_pcie_1_1_ep_s6.edif
PCIE/axi_basic_rx_summary.html
PCIE/axi_basic_tx_summary.html
PCIE/coregen.cgp
PCIE/coregen.log
PCIE/edit_s6_pcie_v2_3.tcl
PCIE/iseconfig/s6_pcie_v2_3.projectmgr
PCIE/iseconfig/s6_pcie_v2_3.xreport
PCIE/iseconfig/xilinx_pcie_1_1_ep_s6.xreport
PCIE/pa.fromNetlist.tcl
PCIE/par_usage_statistics.html
PCIE/PCIE.cgc
PCIE/PCIE.cgp
PCIE/planAhead.ngc2edif.log
PCIE/planAhead_run_1/planAhead_run.log
PCIE/s6_pcie_v2_3/doc/ds801_s6_pcie.pdf
PCIE/s6_pcie_v2_3/doc/s6_pcie_v2_3_vinfo.html
PCIE/s6_pcie_v2_3/doc/ug672_S6_IntEndptBlock_PCIe.pdf
PCIE/s6_pcie_v2_3/example_design/pcie_app_s6.v
PCIE/s6_pcie_v2_3/example_design/PIO.v
PCIE/s6_pcie_v2_3/example_design/PIO_32_RX_ENGINE.v
PCIE/s6_pcie_v2_3/example_design/PIO_32_TX_ENGINE.v
PCIE/s6_pcie_v2_3/example_design/PIO_EP.v
PCIE/s6_pcie_v2_3/example_design/PIO_EP_MEM.v
PCIE/s6_pcie_v2_3/example_design/PIO_EP_MEM_ACCESS.v
PCIE/s6_pcie_v2_3/example_design/PIO_TO_CTRL.v
PCIE/s6_pcie_v2_3/example_design/xilinx_pcie_1_1_ep_s6.v
PCIE/s6_pcie_v2_3/example_design/xilinx_pcie_1_lane_ep_xc6slx45t-fgg484-2.ucf
PCIE/s6_pcie_v2_3/example_design/xilinx_pcie_1_lane_ep_xc6slx45t-fgg484-3.ucf
PCIE/s6_pcie_v2_3/example_design/xilinx_pcie_1_lane_ep_xc6slx45t-fgg484-322.ucf
PCIE/s6_pcie_v2_3/implement/implement.bat
PCIE/s6_pcie_v2_3/implement/implement.sh
PCIE/s6_pcie_v2_3/implement/xst.prj
PCIE/s6_pcie_v2_3/implement/xst.scr
PCIE/s6_pcie_v2_3/s6_pcie_v2_3_readme.txt
PCIE/s6_pcie_v2_3/simulation/dsport/gtx_drp_chanalign_fix_3752_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/gtx_rx_valid_filter_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/gtx_tx_sync_rate_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/gtx_wrapper_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_2_0_rport_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_2_0_v6_rp.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_brams_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_bram_top_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_bram_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_clocking_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_gtx_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_pipe_lane_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_pipe_misc_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_pipe_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_reset_delay_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pcie_upconfig_fix_3451_v6.v
PCIE/s6_pcie_v2_3/simulation/dsport/pci_exp_usrapp_cfg.v
PCIE/s6_pcie_v2_3/simulation/dsport/pci_exp_usrapp_com.v
PCIE/s6_pcie_v2_3/simulation/dsport/pci_exp_usrapp_pl.v
PCIE/s6_pcie_v2_3/simulation/dsport/pci_exp_usrapp_rx.v
PCIE/s6_pcie_v2_3/simulation/dsport/pci_exp_usrapp_tx.v
PCIE/s6_pcie_v2_3/simulation/dsport/xilinx_pcie_2_0_rport_v6.v
PCIE/s6_pcie_v2_3/simulation/functional/board.f
PCIE/s6_pcie_v2_3/simulation/functional/board.v
PCIE/s6_pcie_v2_3/simulation/functional/isim_cmd.tcl
PCIE/s6_pcie_v2_3/simulation/functional/simulate_isim.bat
PCIE/s6_pcie_v2_3/simulation/functional/simulate_isim.sh
PCIE/s6_pcie_v2_3/simulation/functional/simulate_mti.do
PCIE/s6_pcie_v2_3/simulation/functional/simulate_ncsim.sh
PCIE/s6_pcie_v2_3/simulation/functional/simulate_vcs.sh
PCIE/s6_pcie_v2_3/simulation/functional/sys_clk_gen.v
PCIE/s6_pcie_v2_3/simulation/functional/sys_clk_gen_ds.v
PCIE/s6_pcie_v2_3/simulation/functional/wave.do
PCIE/s6_pcie_v2_3/simulation/functional/wave.sv
PCIE/s6_pcie_v2_3/simulation/functional/wave.tcl
PCIE/s6_pcie_v2_3/simulation/functional/wave.wcfg
PCIE/s6_pcie_v2_3/simulation/tests/tests.v
PCIE/s6_pcie_v2_3/source/axi_basic_rx.v
PCIE/s6_pcie_v2_3/source/axi_basic_rx_null_gen.v
PCIE/s6_pcie_v2_3/source/axi_basic_rx_pipeline.v
PCIE/s6_pcie_v2_3/source/axi_basic_top.v
PCIE/s6_pcie_v2_3/source/axi_basic_tx.v
PCIE/s6_pcie_v2_3/source/axi_basic_tx_pipeline.v
PCIE/s6_pcie_v2_3/source/axi_basic_tx_thrtl_ctl.v
PCIE/s6_pcie_v2_3/source/gtpa1_dual_wrapper.v
PCIE/s6_pcie_v2_3/source/gtpa1_dual_wrapper_tile.v
PCIE/s6_pcie_v2_3/source/pcie_brams_s6.v
PCIE/s6_pcie_v2_3/source/pcie_bram_s6.v
PCIE/s6_pcie_v2_3/source/pcie_bram_top_s6.v
PCIE/s6_pcie_v2_3/source/s6_pcie_v2_3.v
PCIE/s6_pcie_v2_3.gise
PCIE/s6_pcie_v2_3.veo
PCIE/s6_pcie_v2_3.xco
PCIE/s6_pcie_v2_3.xise
PCIE/s6_pcie_v2_3.xlpp
PCIE/s6_pcie_v2_3_flist.txt
PCIE/s6_pcie_v2_3_summary.html
PCIE/s6_pcie_v2_3_verilog_example_project.xise
PCIE/s6_pcie_v2_3_xmdf.tcl
PCIE/tmp/_xmsgs/pn_parser.xmsgs
PCIE/Untitled.cfi
PCIE/Untitled.mcs
PCIE/Untitled.prm
PCIE/webtalk.log
PCIE/webtalk_pn.xml
PCIE/xilinx_pcie_1_1_ep_s6.bgn
PCIE/xilinx_pcie_1_1_ep_s6.bit
PCIE/xilinx_pcie_1_1_ep_s6.bld
PCIE/xilinx_pcie_1_1_ep_s6.cmd_log
PCIE/xilinx_pcie_1_1_ep_s6.drc
PCIE/xilinx_pcie_1_1_ep_s6.lso
PCIE/xilinx_pcie_1_1_ep_s6.ncd
PCIE/xilinx_pcie_1_1_ep_s6.ngc
PCIE/xilinx_pcie_1_1_ep_s6.ngd
PCIE/xilinx_pcie_1_1_ep_s6.ngr
PCIE/xilinx_pcie_1_1_ep_s6.pad
PCIE/xilinx_pcie_1_1_ep_s6.par
PCIE/xilinx_pcie_1_1_ep_s6.pcf
PCIE/xilinx_pcie_1_1_ep_s6.prj
PCIE/xilinx_pcie_1_1_ep_s6.ptwx
PCIE/xilinx_pcie_1_1_ep_s6.stx
PCIE/xilinx_pcie_1_1_ep_s6.syr
PCIE/xilinx_pcie_1_1_ep_s6.twr
PCIE/xilinx_pcie_1_1_ep_s6.twx
PCIE/xilinx_pcie_1_1_ep_s6.unroutes
PCIE/xilinx_pcie_1_1_ep_s6.ut
PCIE/xilinx_pcie_

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