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  1. clock

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  2. clockVHDL数字钟模块CNT60_2 该模块为60进制计数器,计时输出为秒的数值,在计时到59时送出进位信号CO,因为硬件有延时,所以模块CNT60_2在此模块变为00时加1,符合实际。-clockVHDLCapable of normal hours, minutes, seconds, chronograph functions, six digital tube display 24h, 60min, 60s. Sa key is pressed, the timer incre
  3. 所属分类:Other systems

    • 发布日期:2017-04-01
    • 文件大小:662
    • 提供者:铁笼
  1. a

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  2. 数字钟,可以实现调时间,报警,报时简单实用-Digital clock, you can adjust the time, alarm, timer
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-06
    • 文件大小:192259
    • 提供者:吴刚
  1. KSSZZ

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  2. PIC数字钟程序,PIC16F887 DS1307 LCD-A SHUZHIZHONG program
  3. 所属分类:Other Embeded program

    • 发布日期:2017-03-23
    • 文件大小:220968
    • 提供者:金黄色
  1. 2410_TEST_UEB

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  2. 该程序描写s3c2410的相关配置,以及一些基本功能的实现。如打电话话、收发短信、数字钟-The program descr iption s3c2410 related configuration, and some basic function. Such as call words, use of text messages, a digital clock
  3. 所属分类:ARM-PowerPC-ColdFire-MIPS

    • 发布日期:2017-05-01
    • 文件大小:578610
    • 提供者:陈旭
  1. dianzizhong

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  2. 该程序利用c语言以及单片机实现一些简单的基本功能。如数字钟、日历、爱心led灯显示、定时打铃等功能-The program using c language, and the single chip microcomputer some simple basic functions. Such as a digital clock, calendar, love led lights display, timing the bell ring etc. Function
  3. 所属分类:其他嵌入式/单片机内容

    • 发布日期:2013-05-19
    • 文件大小:1812751
    • 提供者:陈旭
  1. CLOCK

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  2. 利用CPLD实现的数字钟,已经验证通过。-the clock with cpld
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:335660
    • 提供者:king
  1. shuziCLOCK

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  2. 基于FPGA的数字钟程序,结构思路清晰,适合初学者-the clock for FPGA
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:771656
    • 提供者:汪中
  1. aa

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  2. Javascr ipt是一种能让你的网页更加生动活泼的程式语言,也是目前网页中设计中最容易学又最方便的语言。你可以利用Javascr ipt轻易的做出亲切的欢迎讯息、漂亮的数字钟、有广告效果的跑马灯及简易的选举,还可以显示浏览器停留的时间。让这些特殊效果提高网页的可观性。 -Javascr ipt is a make your website more lively programming language, the current page design easy to learn and
  3. 所属分类:JavaScript

    • 发布日期:2017-04-08
    • 文件大小:6273
    • 提供者:涂匀
  1. EDA1

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  2. 用VHDL编程实现序列信号发生器与检测器设计和数字钟设计-VHDL programming sequence signal generator and detector design and the design of the digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:260493
    • 提供者:高华
  1. A

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  2. 基于CPLD的VHDL语言数字钟(含秒表)设计及程序 利用一块芯片完成除时钟源、按键、扬声器和显示器(数码管)之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短(设计过程中即可实现时序仿真)、调试方便、故障率低、修改升级容易等特点。-The VHDL language based on CPLD digital clock (including a stopwatch) design and program By usin
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:95532
    • 提供者:ruohai
  1. shuzishizhong

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  2. 多功能数字钟具有如下功能 1.秒/分/时的依次显示并正确计数; 2.定时闹钟:实现整点报时,扬声器发出报时声音; 3.时间设置,即手动调时功能:当认为时钟不准确时,可以分别对分/时进行调整;-The multi-function digital clock has the following features 1. Sec/min/turn and correct count 2. Regular alarm clock: the whole point of time,
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:30967
    • 提供者:张小白
  1. DianZiZhong

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  2. 智能数字钟完整Verilog HDL代码,数码管显示,三个按键控制,能完整显示年月日和时分秒及对其的调整设置,能设置闹钟,有秒表,有10秒倒计时-Alarmclock Verilog HDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:10634
    • 提供者:豪哥
  1. javasunhotel

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  2. Javascr ipt是一种能让你的网页更加生动活泼的程式语言,也是目前网页中设计中最容易学又最方便的语言。你可以利用Javascr ipt轻易的做出亲切的欢迎讯息、漂亮的数字钟、有广告效果的跑马灯及简易的选举,还可以显示浏览器停留的时间。让这些特殊效果提高网页的可观性-var myVariable = "some value"
  3. 所属分类:JavaScript

    • 发布日期:2017-05-26
    • 文件大小:9064497
    • 提供者:落日的霞光
  1. seconds

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  2. 数字钟,通过按键调整时间,定时,lcd显示-The digital clock, through the button to adjust the time, timing, LCD display
  3. 所属分类:SCM

    • 发布日期:2017-04-08
    • 文件大小:33223
    • 提供者:周赤
  1. clock(1602)

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  2. 基于51单片机、DS1302、1602液晶的多功能数字钟。-51 single-chip, DS1302, 1602 LCD-based multi-function digital clock.
  3. 所属分类:SCM

    • 发布日期:2017-04-04
    • 文件大小:107318
    • 提供者:张运辉
  1. digclock

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  2. 基于keil的51单片机数字钟,并在proteus上做仿真,语言为c语言-The keil of 51 single-chip digital clock, and to do simulation in proteus, language c language
  3. 所属分类:SCM

    • 发布日期:2017-04-16
    • 文件大小:17483
    • 提供者:
  1. clock

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  2. 数字钟实验,在单片机中实现数字时钟的倒计时的功能-Digital clock experiments, the microcontroller digital clock countdown function
  3. 所属分类:SCM

    • 发布日期:2017-04-07
    • 文件大小:117490
    • 提供者:胡淦
  1. shuzizhong

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  2. 本数字钟可实现正常计时,支持12小时和24小时两种计时方式的切换,允许用户手动调时和整点报时功能。 系统对外向用户提供了两个按键:功能键和调整键.功能键用于功能选择,调整键用于相关的时间调整. 当接通电源后系统便开始正常计时,如果按一下功能键,则进入调小时模式,再按一次则进入调分模式,再按则进入12/24小时模式选择设定,再按则恢复到正常计时状态. 在正常计时状态下,用户可以选择12或24小时的计时方式,第六个数码管的右下方小点亮表示是12小时模式,不亮表示24小时。整点报时时,六个数码管的
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:17839
    • 提供者:ggy
  1. clock

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  2. 数字钟,采用电平触发,可以切换显示模式。-Digital clock, trigger level, you can switch the display mode.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:296473
    • 提供者:tsubasa
  1. soc-count

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  2. soc 的 vhdl语言设计的基于嵌入式 数字钟-soc vhdl language design based on embedded digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:4858
    • 提供者:张博
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